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半導体/技術職(機械・電気)/年収1200万円以上/50代以上の求人・転職・中途採用情報

公開求人96件中 1〜50件表示
元日系大手Grの外資系光半導体デバイスメーカー
元日系大手Grの外資系光半導体デバイスメーカー

光半導体プロセス開発エンジニア<新規プロセス開発>

NEW
外資系企業
職種/業界
プロセスエンジニア / 半導体
年収
900万円~1,300万円
勤務地
神奈川県

光通信用途の高速光素子の作製プロセス技術開発を担当していただきます。 【具体的には】 ・ウェット/ドライエッチング、メタライゼーション、リソグラフィなどの NPI (New Product Introduction:新製品導入) のための個別プロセス研究の計画と実行。 ・上記の職務を達成するために、R&D設計チーム および OPSウェハ製造・生産技術チーム と連携・協力する。 ・将来の量産に適用可能なプロセスフローを作成するために、プロセスステップをインテグレーション(統合) する。 ・生産性、歩留まり、コストの改善に貢献する 新しいプロセス技術を提案 する。 【本ポジションのミッション】 本ポジションは、光通信用半導体レーザ・フォトダイオードのウエハプロセスの開発を通して産業変革を支えるキーデバイスを創ることがミッションです。 次世代の製品を開発する上で、安定して量産できるかどうか、お客様の必要な製品へと仕上げられるかどうか、生産プロセスが肝心要な役割を担っています。 開発していただくのはInPウエハでの光半導体素子を作り上げるためのプロセス。スピード感のある開発サイクルの中で、ご知見とスキルセットを活かし、世界のデータ通信インフラを一緒に作っていただける方を募集しています。

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キオクシア株式会社
キオクシア株式会社

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不良解析・品質改善<コントローラ搭載メモリ製品>

職種/業界
実験・評価・解析 / 半導体
年収
550万円~1,260万円
勤務地
神奈川県横浜市栄区

特定顧客向けコントローラ搭載メモリ製品の不良解析、および将来のチームリーダーとして業務全体をリードするポジションです。市場不具合から開発・出荷段階の品質課題まで幅広く対応し、品質向上や歩留改善に貢献いただきます。 【具体的には】 ■不良品の解析(顧客返却品・社内テスト品・出荷テスト品): 不具合の再現試験やログ解析を実施し、主にコントローラ関連の不良要因を特定。結果をフィードバックし、歩留・品質改善へ繋げます。 ■結果報告と調整業務: 解析結果を報告資料にまとめ、顧客や社内関係部門(開発・品証・製造)へ報告・調整を行います。 ■解析環境の構築: 解析用ボード製作やプログラム開発・改良を行い、解析環境を整備します。 ■関係部門との調整業務:開発、品質保証、製造などの関係部門と連携しながら、解析スケジュールや解析方針の調整を行います。複数部門を横断して解析プロジェクトの進行を取りまとめます。 【業務のやりがい・魅力】 ■成長事業への貢献: 注力製品の品質向上に直結し、製品競争力や事業成長を実感できます。 ■広い技術的視野: 開発から量産、市場品質まで多様な部門と連携し、半導体開発全体を俯瞰する知識が得られます。 ■主体的な課題解決: 解析手法の検討やツール改善など、アイデアを活かして挑戦できる環境です。 【技術優位性】 特定顧客向けコントローラ搭載メモリ製品において、顧客技術と自社技術を融合した製品を実現し、最先端のモバイルデバイスに搭載されています。

先行開発<エンタープライズ/データセンター向け次世代SSD製品>

職種/業界
研究・開発 / 半導体
年収
550万円~1,260万円
勤務地
神奈川県横浜市栄区

エンタープライズ/データセンター向けSSDの次世代製品開発の技術検討・先行開発をご担当いただきます。 【具体的な仕事内容】 ■次世代製品の技術検討・仕様策定:最新の技術動向や市場ニーズに応じた、次世代SSDの製品コンセプト・要求仕様の検討 ■先行開発・要素技術の検証:本格開発に向けた要素技術の確立、およびプロトタイプによる技術検証・課題抽出の推進 ■開発チームへの引き継ぎ・連携:先行開発の成果を整理し、プロジェクトリーダー(PL)が率いるメイン開発フェーズへスムーズに引き継ぐための技術共有・連携 【業務のやりがい・魅力】 データストレージは、さまざまな業界や社会インフラにおいて重要な要素であり、特にクラウド/ソーシャルネットワークを支えるデータセンターやAIインフラシステムには不可欠な存在です。あなたの開発成果が、企業のデジタルトランスフォーメーションに寄与し、AIのトレーニングや推論の実装を加速させます。 さまざまなバックグラウンドを持つエンジニアと共にストレージ技術の開発に取り組むことで、プロジェクトマネジメント、リスクマネジメント、交渉力等のビジネススキルを向上させていくと共に、SSDの技術の専門性を高めながら、今までにない製品の開発を通じて社会に貢献することができます。 【技術優位性】 同社のSSDは自社開発の3D NANDフラッシュ技術を活用し、高密度で高性能なストレージソリューションを提供しております。エンタープライズやデータセンター向けSSDについては業界トップレベルの性能、品質のSSDを提供しお客様より高い評価を受けています。2025年度FMSにて、KIOXIA SSD LC9がBest of Show Awardを受賞。

元日系大手Grの外資系光半導体デバイスメーカー
元日系大手Grの外資系光半導体デバイスメーカー

テストエンジニア<光半導体チップ>

外資系企業
職種/業界
実験・評価・解析 / 半導体
年収
1,000万円~1,300万円
勤務地
神奈川県

テストエンジニアのマネージャー候補として以下業務をご担当いただきます。 【具体的には】 ・チップテストエンジニア部門におけるリードとして予算、計画進捗を管理。 ・半導体光デバイス製造後工程における、チップテスト、歩留り改善、作業改善の策定と遂行指揮。 ・テスト工程における生産効率化に向けた有効なKPIの導入計画と実行。 ・大量のデータを効率的に分析し課題解決に向けてチームをリードする。 【本ポジションのミッション】 ・メガデータセンタ(MDC)、人工知能/マシンラーンニング(AI/ML)分野でなくてならない最先端の200Gbps等ハイスピードなInP系化合物半導体レーザチップのテスト生産技術部隊を課長レベルの職務で統括、管掌していただきます。 ・半導体製造でのテスト技術に関する知識と経験を身につけることができます。 ・半導体製造でのテスト技術に関する豊富な知識と経験および生産技術部門のマネージメントの能力も身につけていただけます。 ・チップ製造ラインの歩留および生産効率の改善、改革に向けた戦略的長期/短期計画の策定、メンバー育成も同時に担当いただきます。

先端半導体の開発・製造を目指す、日系の半導体メーカー
先端半導体の開発・製造を目指す、日系の半導体メーカー

企画管理チームシニアマネージャー

職種/業界
生産管理 / 半導体
年収
1,200万円~1,400万円
勤務地
北海道

■生産管理部の企画管理機能の責任者として、受注管理・生産管理・購買管理・物流管理・製造管理・在庫管理全体のKPI体系構築と運営を推進いただきます。 【具体的には】 QMSに基づく管理指標の整備、データ分析による経営課題の抽出、人員計画の策定、DX・GX施策の推進、他部門との横断調整を担当いただき、生産管理部の意思決定を支援する戦略・企画業務を担当いただきます。

先端半導体の開発・製造を目指す、日系の半導体メーカー
先端半導体の開発・製造を目指す、日系の半導体メーカー

企画管理チームマネージャー

職種/業界
生産管理 / 半導体
年収
1,000万円~1,300万円
勤務地
北海道

■企画管理チームの中核メンバーとして、生産管理部のKPI運営および分析業務をご担当いただきます。 【具体的には】 QMS指標の集約・分析、生産オペレーションに関する課題の可視化、人員計画の取りまとめ、DX・GX活動の推進、システム部門とのデータ整備に関する調整、関連部門との連携・改善活動の推進をご担当いただき、組織運営の高度化に貢献していただきます。

インダストリアル エンジニアリング<メモリ半導体>

外資系企業
職種/業界
生産管理 / 半導体
年収
700万円~1,200万円
勤務地
三重県四日市市

下記業務を担当いただきます。 ■具体的には 半導体生産工場の稼働状態の監視、分析 ・製品進捗状況 (納期、不良率、新製品試作、動線) の分析と出荷数予測 ・ プロセスエンジニアとの連携による生産性改善(アウトプット向上、サイクルタイム改善、コスト削減) ・トラブルや災害発生時の状況分析、復旧予測 ・上記分析に使用するシステムの改善、AIの活用 (機能改善、ユーザビリティの改善)

SI/PIシミュレーション・技術開発<SSD製品>

職種/業界
電気回路設計 / 半導体
年収
550万円~1,260万円
勤務地
神奈川県横浜市栄区

■先行開発チームの一員として、PCIe、DRAM、NANDといった各種高速インターフェースや電源供給ネットワークを中心に、SSDのSI/PIシミュレーションをはじめとする技術開発をご担当いただきます。担当分野は、開発中製品のSI/PI検証から次世代製品に向けた先行要素技術開発まで、幅広い領域にわたります。 【具体的には】 ・SSD製品のSI/PIシミュレーション:PCBの電磁界シミュレーションや、IOモデルと組み合わせた回路シミュレーションなど、SSD製品開発におけるSI/PI検証を実施いただきます。特性未達の場合、改善案の検討や、仕様変更などの開発方針を提示します。 ・先行技術開発:新しい回路技術や基板技術の取り込みや、将来の性能実現性検討など、SSD製品開発に先立った次世代要素技術の検討に取り組んでいただきます。 ・SI/PIシミュレーション環境の更新:SI/PIシミュレーションを実施頂くだけではなく、シミュレーション技術の応用、実測比較によるシミュレーション精度向上、ツールやHW設計に関する社内外動向調査など、SI/PIに関わる技術開発全般に幅広く貢献頂きます。 【使用ツール】 電磁界シミュレータ:SIwave/HFSS、PowerSI/Clarity 他 回路シミュレータ:Spectre/SystemSI、ADS、HSPICE 他 【業務のやりがい・魅力】 SSDの高速化・大容量化は今後も進展し続け、SI/PI技術はその土台を支える重要な分野です。難易度が高く専門性の高い技術を習得できるだけでなく、各種ICをつなぐコア技術でもあるため、SSDのハードウェア全体にわたる幅広い知見を身につけることができます。また、現行製品開発から次世代技術の要素技術検討まで、製品開発の最前線で技術開発に携わることができます。

オン・セミコンダクター会津株式会社

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生産技術(装置/プロセス) マネージャー

外資系企業
転勤なし
職種/業界
工場長 / 半導体
年収
1,000万円~1,700万円
勤務地
福島県会津若松市

半導体前工程(8インチ)の拡散・インプラ(イオン注入)の装置/プロセスエンジニアリングマネージャーとして現場をリードしていただきます。 【具体的には】 - 生産技術・プロセス開発: 拡散・インプラ工程の量産技術確立、プロセス最適化、新技術・新規装置の立ち上げ - 歩留・品質改善: 不具合発生時の原因究明、対策立案、歩留まり(Yield)向上、品質保証 - チームマネジメント( 約10名のメンバー):チームの目標設定、リソース管理、メンバーの育成・評価 - コスト・設備管理: 装置の稼働率向上、生産性向上プロジェクトの推進、設備投資(CAPEX)の計画・実行

QAQC

外資系企業
職種/業界
品質管理 / 半導体
年収
500万円~1,300万円
勤務地
岩手県北上市

■仕事概要 メモリデバイス製造工程の工程品質管理を他部門(プロセス、製品技術等)と連携しながら継続的改善のPDCAを実行していただきます。異常管理、IQC(Inline Quality Control) , TEG(Test Element Group)のCpk/SPCモニタリング、変更管理、FMEA活用等を推進します。EES(Equipment Engineering System)や、FDC(Fault Detection Classification)を用いたリアルタイム監視環境、並びにBig Data, AIを活用したデータベースから、分析結果を対策に繋げることにより、お客様の求めるレベルを超える品質の実現に繋げていただきます。 また、メモリデバイスの品質保証のため、製造工程で発生した品質問題の原因究明と是正、並びに信頼性評価や試験データを調査し製品処置を決めて行きます。 製品処置については、海外工場やUS本社と連携しながら対応しております。 ■具体的には  ・統計的工程監視、工程能力評価  ・リアルタイムモニター  ・品質マネジメントシステム、文書管理  ・工程変更の管理  ・品質問題発生時の製品処置  ・データベース構築、活用 【ポジションの魅力】 現在は、半導体製造工程等で発生する膨大なデータ解析から、不良現象等を解明し、歩留り向上のために製造工程にフィードバックしています。将来的には、リアルタイムでデータを抽出し、不良を「予防」することも視野に入れるなど、技術を磨ける環境です。自身の仕事がダイレクトに高性能製品の反映される仕事になります。

世界トップクラスの外資系半導体ファンドリーの日本法人
世界トップクラスの外資系半導体ファンドリーの日本法人

PLL回路設計エンジニア

外資系企業
職種/業界
電気回路設計 / 半導体
年収
500万円~1,200万円
勤務地
大阪府

■同社にて下記業務を担当していただきます。 ・TSMCの先端プロセスノードにおける、アナログPLLまたはオールデジタルPLL(ADPLL)の設計。 ・先端プロセスにおけるミックスドモード(混在シグナル/アナログ・デジタル混在)の設計フロー。 ・PLL回路の観点からの、デバイスのベンチマーク(性能評価・比較)。

デザインエンジニア <アナログ回路/メモリ半導体>

外資系企業
職種/業界
電気回路設計 / 半導体
年収
700万円~1,600万円
勤務地
東京都港区 他

同社のデザインエンジニア(回路設計職)として、NAND型フラッシュメモリLSIのアナログ回路設計設計を担当していただきます。 【具体的には】 ■ NAND型フラッシュメモリLSI回路設計、特に以下のうち1つもしくは複数のモジュールに関わる回路設計 - セルアレイに付随するセンスアンプやワード線ドライバ、もしくはそれらに直接つながるスイッチング回路、デコーダ回路などを含むコア回路設計 - チップ内部での高速低消費電力データパス回路設計 - チップ外部とのデータ・コマンドをやり取りする高速インターフェース回路設計 - 内部データの高速演算とデータ転送を実現するMixed Signal回路設計 ■デバイスエンジニア、テストエンジニアとの共同での製品設計や製品機能の検討と決定 ■共同開発パートナ、自社他拠点とのコミュニケーションおよびインターフェイス 【魅力】 ■最先端性:本社がシリコンバレーにあるため、世界の半導体に関する最先端の情報をいち早く入手し、開発に生かすことができます。グローバルな舞台で最先端の技術を駆使し、時代をリードする製品開発を行うことが可能です。 ■裁量の大きさ:9割外資系企業特有の風通しの良さが魅力です。技術の提案等を行うことができ、技術者としてのレベルアップを図りやすい環境が整っています。 ■キャリアパス:エンジニアとしてスペシャリストのキャリア選択をすることが可能です。

デザインエンジニア <ロジック回路/メモリ半導体>

外資系企業
職種/業界
電気回路設計 / 半導体
年収
700万円~1,600万円
勤務地
東京都港区 他

同社のデザインエンジニア(回路設計職)として、NAND型フラッシュメモリLSIのロジック回路設計設計を担当していただきます。 【具体的には】 ■NAND型フラッシュメモリLSIのロジック回路設計 - RTLデザインとVerilogによる検証、RTLリント、CDC(Clock Domain Crossing)分析、タイミング解析とタイミング収束、チップのDFT設計及び検証 - コマンドデコーダおよびコマンドに従って信号を発生するシーケンサなどを含むロジック回路 - NANDフラッシュメモリのコア部を制御するためのステートマシンなどを含むロジック回路設計 - 高速データパスや外部とのインターフェースを制御するための制御ロジック回路設計 ■デバイスエンジニア、テストエンジニアとの共同での製品設計や製品機能・仕様の検討と決定 ■共同開発パートナ、自社他拠点とのコミュニケーションおよびインターフェイス 【魅力】 ■最先端性:本社がシリコンバレーにあるため、世界の半導体に関する最先端の情報をいち早く入手し、開発に生かすことができます。グローバルな舞台で最先端の技術を駆使し、時代をリードする製品開発を行うことが可能です。 ■裁量の大きさ:9割外資系企業特有の風通しの良さが魅力です。技術の提案等を行うことができ、技術者としてのレベルアップを図りやすい環境が整っています。 ■キャリアパス:エンジニアとしてスペシャリストのキャリア選択をすることが可能です。

世界トップクラスの外資系半導体ファンドリーの日本法人
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高速インターフェース設計ソリューション・エンジニア

外資系企業
職種/業界
電気回路設計 / 半導体
年収
500万円~1,200万円
勤務地
大阪府

■同社にて下記業務を担当していただきます。 ・従来のSerDes(シリアル・デシリアライザ)またはチプレット・インターコネクト(チップ間接続)向けの高速インターフェース設計(送受信回路[TX/RX]、イコライゼーション、クロッキング)。 ・電気的性能の最適化や信頼性の向上など、高速インターフェース向けの技術機能の評価および実装の推進。 ・2.5D/3D IC(積層半導体パッケージ技術)のチャネルモデリング(伝送路のモデル化)。

世界トップクラスの外資系半導体ファンドリーの日本法人
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スタンダードセル設計エンジニア

外資系企業
職種/業界
電気回路設計 / 半導体
年収
500万円~1,200万円
勤務地
大阪府

■同社にて下記業務を担当していただきます。 ・スタンダードセルの回路要件の定義、および回路図(回路設計)からレイアウト、検証に至る一連の設計作業の完遂。 ・HspiceやSpectreなどの業界標準シミュレーションツールを用いた、ディープサブミクロンCMOSテクノロジーの回路設計(回路図作成)。 ・TSMCのプロセス技術において最適なPPA(性能・電力・面積)を達成するための回路最適化。 ・最先端テクノロジーノードにおける回路設計のパスファインディング(先行検討・方向性の探索)および革新。 ・IoTアプリケーション向けのサブスレッショルド(サブ閾値)電圧回路設計。 ・レイアウトエンジニアと連携し、速度、電力、およびEMIR(エレクトロマイグレーション&IRドロップ)に対して最適化されたアーキテクチャの定義。

世界トップクラスの外資系半導体ファンドリーの日本法人
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レイアウト設計エンジニア

外資系企業
職種/業界
電気回路設計 / 半導体
年収
500万円~1,200万円
勤務地
大阪府

■同社にて下記業務を担当していただきます。 ・RDR(制限付きデザインルール)の最適化。 ・先端テクノロジーにおける、スタンダードセル、I/Oライブラリ、メモリ、およびアナログIPの開発。 ・メモリIP、コンパイラ、およびテストビークル(評価用試作チップ)の開発。 ・スタンダードセル、I/Oライブラリ、およびアナログIPの開発。 ・面積(コスト)と性能における、デザインルールのトレードオフの提示・評価。 ・面積に対するRDRの影響を低減するための、スタンダードセル、I/Oライブラリ、メモリ、およびアナログIPのレイアウトソリューションの考案。

世界トップクラスの外資系半導体ファンドリーの日本法人
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メモリ設計エンジニア

外資系企業
職種/業界
電気回路設計 / 半導体
年収
500万円~1,200万円
勤務地
大阪府

■同社にて下記業務を担当していただきます。 ・メモリアーキテクチャ設計(SRAM、DRAM、MRAM、RRAM、PCRAM、および組み込みフラッシュメモリ[eFlash])。 ・読み出し(Read)および書き込み(Write)のクリティカルパス設計と解析。 ・主要な構成ブロック(センスアンプなどのセンシング回路、アナログ回路、高電圧回路、DFT[テスト容易化設計])の設計。 ・チップレベルの設計検証。 ・組み込み型不揮発性メモリ(eNVM)コンパイラの開発および製品化。 ・プロダクトエンジニアや信頼性エンジニアと連携した、実シリコン(試作チップ)の特性評価および信頼性認定の実施。

世界トップクラスの外資系半導体ファンドリーの日本法人
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フロントエンド設計エンジニア

外資系企業
職種/業界
電気回路設計 / 半導体
年収
500万円~1,200万円
勤務地
大阪府

■同社にて下記業務を担当していただきます。 ・先端テクノロジーチップにおける、RTL論理合成、SDC/UPF検証、および低消費電力設計の実装。 ・フロントエンド設計における課題に対応するための、設計フローやメソドロジー(設計手法)の開発および革新。 ・顧客プロジェクトおよび社内のシステムテストチップにおける、RTL検証、論理合成、低消費電力設計、およびSTA(静的タイミング解析)/タイミングクロージャ(タイミング収束)業務の担当。

世界トップクラスの外資系半導体ファンドリーの日本法人
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物理設計エンジニア

外資系企業
職種/業界
電気回路設計 / 半導体
年収
500万円~1,200万円
勤務地
大阪府

■物理設計エンジニアは、集積回路(IC)の物理的なレイアウトを設計し、製造プロセスに適した最適なレイアウトを確保します。 タイミング、電力消費、面積、および製造の実現可能性を考慮しながら、IC設計の実装を担当します。 【具体的には】 1. 論理設計から物理設計への変換: RTLコードからのネットリストを受け取り、物理設計への変換を行う。 フロアプランニング、パワープランニング、クロックツリー合成(CTS)を行う。 2. タイミングクロージャー: タイミング解析を行い、静的タイミング解析(STA)ツールを用いてタイミングクロージャーを達成する。 セットアップ、ホールドタイム、遅延の最適化を実施する。 3. 電力解析と最適化: - 電力解析を実施し、消費電力の最小化を図る。- 電力グリッド設計およびIRドロップ解析を行う。 4. 設計ルールチェック(DRC)およびレイアウト対回路チェック(LVS): DRCおよびLVSツールを用いて、設計が製造可能なものであることを確認する。 レイアウトの修正および最適化を行う。 5. クロックツリー合成(CTS)および信号整合性(SI)解析: クロックツリーの設計および最適化を行う。信号整合性解析を実施し、クロストークやEMIの問題を解決する。 6. 物理設計ツールの使用:Cadence、Synopsys、Mentor GraphicsなどのEDAツールを使用して、物理設計を行う。

ファームウェア開発担当(設計/評価)

職種/業界
組み込み・ソフトウェア・電気制御設計 / 半導体
年収
550万円~1,260万円
勤務地
神奈川県横浜市栄区

エンタープライズ、データセンター及びAIサーバ向けSSDのファームウェア開発担当として、下記業務をご担当いただきます。 ファームウェアの開発は、機能毎で複数のチームに分割して進めているため、いずれかのチームにて業務を行っていただきます。 【具体的には】 ■設計業務 ・初期:SSDアーキテクチャおよびファームウェア構造の理解 ・担当モジュール開発:機能設計、コーディング、デバッグ ・仕様管理:各種関連ドキュメントの作成 ■評価業務 ・初期:SSDアーキテクチャおよびファームウェア構造の理解 ・計画策定:設計者と連携した評価計画の立案 ・テスト実行:テストコードの作成・実行 ・品質管理:不具合や問題点の調査・分析 【使用ツール】  C/C++, Python, AIツール Linux、Windows、Redmine. Jira、Jenkins 等

データ基盤担当エンジニア

職種/業界
生産技術 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

半導体製造のテスト工程における自動化を推進するため、以下の業務を担当いただきます。 ・テスト工程の自動化に向けたシステム設計・開発・テスト・保守 ・周辺システムとのインテグレーション(データ連携、制御連携など) ・製造現場のニーズに応じた機能追加・改善提案 ・生産設備との連携を含むシステムインテグレーションの実施

品質マネジメントプロセスエンジニア

職種/業界
品質管理 / 半導体
年収
600万円~1,300万円
勤務地
東京都千代田区

■半導体ファウンドリビジネスにおいて、ビジネス本部の立場で、受注から設計量産に至る品質マネジメントシステムの運営・管理及び高度化をご担当いただきます。 【具体的には】 ・受注~開発~量産の業務プロセスマネジメントの運営及び管理 ・上記活動の情報記録及び管理 ・上記活動に対する内部監査及び外部審査の対応 ・品質マネジメントプロセスの運営と改善 ・その他の関連業務

シャトルマネジメント

職種/業界
プロセスエンジニア / 半導体
年収
600万円~1,300万円
勤務地
東京都千代田区

■同社にて、下記業務を担当していただきます。 【具体的には】 ・MPW(シャトルロット)の企画・運用・スケジュール管理 ・設計顧客(ファブレス、研究機関等)との技術・進行調整窓口 ・社内プロセス改善、MPWサービスの高度化提案 【MPWとは】 MPW(Multi-Project Wafer)、別名シャトルロットは、半導体製造において「1枚のシリコンウェハを複数のユーザーやプロジェクトでシェアして製造する方式」を意味します。通常、半導体の製造には膨大なコスト(特に回路を転写するための「マスク」代)がかかりますが、これを「相乗り」することで1社あたりの負担を抑える仕組みです。 ※定期的に運行され、複数の乗客(設計データ)を乗せて目的地(物理的なチップ化)へ運ぶ様子が、定期便のバスや宇宙船の「シャトル」に似ていることから上記のように呼ばれています。

製造実行システム担当エンジニア

職種/業界
生産技術 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

◆職務内容 半導体製造の前工程・後工程における製造ラインを支援する製造実行システム(IBM SiView)のカスタマイズ開発および、周辺システムとのインテグレーションに関する設計・開発・テスト・保守業務を担当いただきます。 ・IBM SiViewの機能拡張・カスタマイズ ・周辺システムとの連携設計(データ連携、制御連携など) ・製造現場の要件に基づくシステム開発(要件定義〜保守まで) ・生産設備とのシステムインテグレーション対応

装置自動化エンジニア

職種/業界
生産技術 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

◆職務内容 半導体製造の前工程・後工程における装置のオンライン接続を実現するため、以下の業務を担当いただきます。 ・装置メーカーとの通信仕様に関する技術的な打ち合わせ ・SECS/GEM300準拠の通信ソフトウェアの設計・開発 ・装置との接続テストおよび動作確認 ・製造現場との連携による導入支援・保守対応

AI/DL開発推進 データ・サイエンティスト

職種/業界
生産技術 / 半導体
年収
600万円~1,200万円
勤務地
北海道千歳市

◆職務内容 AI・DL(Deep Learning)などの機械学習技術を活用し、製造ITシステムへの組み込みを推進するデータサイエンティスト・チームのメンバーとして、以下の業務を担当いただきます。 ・品質・設備領域におけるAIアプリケーションの開発 ・スケジューラや生産計画における最適化AIの設計・実装 ・工場監視システムのKPIチャート生成および自動監視応答対応AI(生成AI)の開発 ・製造現場や海外拠点との連携によるAI活用コンテンツの企画・展開

モデリングエンジニア

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地

同チームのメンバーとして、多様な設計ニーズを持つ顧客がAI(人工知能)アプリケーション向けの製品を実現できるよう、業界最先端のプロセス技術の共同最適化(Co-optimization)の最前線に立っていただきます。コンパクトモデリング・チームは、プロセス開発チームとの設計インターフェースとしての役割を果たし、すべての新しい同社プロセスにおいて、設計とプロセスの主要な相互作用を構築しています。 【具体的には】 高度にインタラクティブなチーム環境において、多様な回路設計環境下でシリコン性能を極めて正確に再現するため、SPICEレベルのシミュレーションに向けた各種デバイスモデルのソフトウェア開発および維持管理を行っていただきます。 ・同社のPDKでサポートされている業界標準の回路シミュレーションツールにおいて、コンパクト/SPICEデバイスモデルのコードおよび方程式の開発・維持管理。 ・モデルパラメータ抽出、新技術開発、およびシリコンプロセス制御モニター(PCM)のためのテスト構造の開発・維持管理。 ・技術開発チームおよびEnablementチームと密接に連携し、高品質なモデルを提供。

Foundation IP(スタンダードセル)開発・管理

職種/業界
電気回路設計 / 半導体
年収
600万円~1,200万円
勤務地
東京都千代田区

Chipレイアウトの基本となるSTDセルの開発、管理担当を担っていただきます。 【具体的には】 設計フローの構築、設計サポート、Sign Off Recommendation(STA、EMIRなど)作成、リキャラクタライズなど広範囲で活躍していただきます。

先端半導体の開発・製造を目指す、日系の半導体メーカー
先端半導体の開発・製造を目指す、日系の半導体メーカー

半導体製造管理シニアマネージャー/マネージャー

職種/業界
生産管理 / 半導体
年収
1,000万円~1,400万円
勤務地
北海道

■半導体製造(前工程・後工程いずれか)のマネジメントを担っていただきます。現場の安定稼働・品質向上・人材育成・工程改善など、製造部門の中核として活躍することが期待されています。 【具体的には】 ・製造部門の統括管理(人員配置、工程管理、設備管理):原価管理、量産用・試作用のロット手配、振出手配、生産活動の運営(チョコ停対策、産業廃棄物の出荷・処理依頼と管理等 ・製造課長・現場リーダーとの連携による業務推進 ・生産性向上・歩留まり改善・品質安定化のための施策立案・実行 ・製造工程の改善活動(QCサークル、5S、カイゼン活動など) ・製造関連規程・標準書の整備と運用 ・安全衛生管理の推進 ・他部門(技術、品質保証、営業など)との連携・調整 ・部門社員の育成・評価・指導

CDK(Chip Design Kit)設計フロー・技術開発

職種/業界
電気回路設計 / 半導体
年収
400万円~1,200万円
勤務地
東京都千代田区

Chip設計に関するフロー開発と関連した最先端プロセス設計に必要な要素技術、ユーティリティの開発を担当していただきます。 【具体的には】 RTL-GDSまでの設計フローについて、リファレンスとなるフローの開発と各工程で必要となる技術をEDAベンダと協力して構築していただきます。また顧客に提供したフローについてのサポートも対応いただきます。チップレット設計とも連携したフローの構築を担当していただきます。

メモリマクロ開発<揮発性メモリ>

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
東京都千代田区

メモリマクロ(揮発性メモリ)開発を担当して頂きます。 【具体的には】 冗長ガイドライン策定、メモリ設計・評価、Yield改善提案など、メモリマクロに関する業務で活躍していただきます。Chip設計サポート、IPベンダーとの交渉も対応していただきます。

MASKエンジニア

職種/業界
電気回路設計 / 半導体
年収
400万円~1,200万円
勤務地
東京都千代田区

下記業務をご担当いただきます。 【具体的には】 ・Fill:チップ上でより均一なパターン密度を作成するために使用されるダミー形状の仕様の作成とコーディング、及びFillセル設計を担当いただきます。 ・Retargeting:下流のマスク作成に使用される最終的なウェーハ寸法に合わせて設計形状を変更するコードを作成する責任を負っていただきます。 ・Kerf: CD(Critical Dimension 測定、アライメント、オーバーレイ、その他の計測要件などのプロセス制御ニーズのために工場で使用される KERF (またはフレーム/スクライブ) 内のマクロを作成する責任を負っていただきます。 KERF エンジニアは、配置制約の対象となる領域内にこれらの個別マクロを配置するための自動化のためのコード作成も行っていただきます。 ・Mask Release:マスク作成に関するスケジュールを調整し、後処理されたデータをマスク製造用のマスクメーカーに転送する責任を負っていただきます。 マスクセット全体の購買管理もしていただきます。

testsite coordinator

職種/業界
プロセスエンジニア / 半導体
年収
400万円~1,200万円
勤務地
東京都千代田区

下記業務をご担当いただきます。 【具体的には】 プロセス/デバイス開発用テストチップのスケジュール立案の他、プロセス技術チーム、デバイス技術チーム、試作ライン、デザインチームとの調整など、テストチップ策定および実行のあらゆる側面でご活躍頂きます。

半導体パッケージ設計エンジニア

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

下記業務をご担当いただきます。 【具体的には】 【1】アドバンスドパッケージ(2.5D/2.xD/3D等)の最適構造検討・提案・仕様整合をお客様の要求をヒアリングしながら行って頂きます。商談初期から量産まで幅広く関与していただくポジションです。 【2】チップレット技術の実現に不可欠な高速インターフェイス(HBM、UCIe、SerDesなど)に関する標準化活動や社内外のロードマップ策定を行っていただきます。 上記の実務経験がなくても、入社してからOJTを通じて経験を積んで頂きます。

デバイス開発用TEG設計エンジニア

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市 他

2nmプロセス及びそれ以降の世代においけるデバイス開発及びプロセス評価用TEGのLayout等の業務全般をご担当いただきます。 【具体的には】 デバイス開発ではトランジスタ特性(電気特性、各種Layout依存性)や抵抗及び容量素子、プロセス評価において各種依存性や異常をモニターするTEGの構想とCADを用いたTEGの作成をいただきます。経験等を考慮し、作成したTEGの配置からマスク作成用GDSデータの作成までの一連の業務を担当していただきます。

半導体テストチップのレイアウト設計<アナログ>

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
東京都千代田区

半導体テストチップのレイアウトDesign及び、プロセスのPPA評価用レイアウトDesignを担当して頂きます。マニュアルでのレイアウトの他に、TCL言語、SKILL言語、その他の言語でスクリプト作成してレイアウト作業をして頂きます。 【具体的には】 先端プロセスのFEOL・BEOLレイアウトルールを理解し、カスタムセル設計可能なレベルのスキルを身に着けて頂く必要があります。また、新たに構築する設計フローに対するトライアル、ツール動作検証、改善提案業務などを担当して頂きます。ジョブローテーションが頻繁にありますので、re-skilling能力が重視されます。

PDK開発エンジニア

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地

同社の革新的なプロセス技術を外部顧客が活用できるようにするため、業界標準のEDAツールを用いたPDKコンポーネントの開発・提供・サポートを行っていただきます。 【具体的には】 ・PDK開発:DRC(デザインルールチェック)、LVS(回路図・レイアウト照合)、RC抽出(寄生容量・抵抗抽出)などのソフトウェア開発と保守 ・QAとフロー改善:PDKおよびPDK-QAフローの構築・維持・改善 ・連携とサポート:外部顧客や内部デザイナーへの技術サポート、およびEDA/IPベンダーや技術開発チームとの共同作業

DFT設計・開発エンジニア

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
東京都千代田区

半導体製品のDFT( Design for Testability)設計・開発業務を担当いただきます。製品の品質向上と歩留まり改善を目的とし、以下の業務を遂行していただきます。 【具体的には】 ・DFT設計手法の開発およびDFT回路設計 ・テスト構造の設計・実装(Scan、BIST、MBISTなど) ・故障診断・解析、歩留まり解析の支援 ・EDAベンダーとの技術的な交渉・調整 ・テスト仕様の策定および設計フローへの組み込み

デジタルチップ設計エンジニア<標準セル開発 & DTCO>

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市 他

デジタルチップ設計エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■標準セルおよびDTCOの推進 ・最先端テクノロジーノード向けの標準セルライブラリの設計、評価、および最適化。 ・DTCO(Design Technology Co-Optimization)活動の計画と実行。回路設計とプロセス技術の連携を強化し、最適なPPA(電力・性能・面積)ターゲットを達成する。 ・カスタムレイアウト、キャラクタライゼーション(特性評価)、および検証フローの開発と改善。 ・設計ルール、プロセスばらつき、および信頼性要件を深く理解した上での設計業務。 ■設計チーム、プロセス・デバイス開発チーム、およびEDAチームと緊密に連携する。 ■PPA目標を達成するため、新しい設計手法やツールの評価および導入を行う。 ■IPベンダーやEDAベンダーとの技術的な協議およびコラボレーション。 ■設計データのドキュメント化および維持管理。

テストチップ設計エンジニア<物理設計・PPA解析>

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市 他

テストチップ設計エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■テストチップの物理設計およびPPA解析 ・バックエンド(BE)実装および関連フローの開発:チップレベルのプランニング、PG(電源/接地)ネットワーク設計から、フロアプラン、配置(Place)、CTS(クロックツリー合成)、配線(Route)、電力解析(PDNAサインオフ)、および包括的な物理検証まで、バックエンド実装フロー全体を推進する。 ・設計手法およびEDAツール・ユーティリティの開発:バックエンド実装に特化した設計手法と、関連するEDAツールのユーティリティを開発・強化する。これには、新しいプロセス技術から生じる課題へのソリューション作成や、顧客を効果的にサポートするためのユーティリティ開発が含まれる。 ・テクノロジー・ベンチマーク:詳細なテクノロジー・ベンチマークを実施し、新しいプロセス技術のPPA特性を徹底的に理解・評価する。 ■プロセス開発チーム、回路設計チーム、およびEDAベンダーと緊密に連携し、堅牢な設計フローを定義・実装する。 ■タイミング、電力、物理検証のエラーを含む、複雑な物理設計上の問題を分析しデバッグする。 ■設計プロセスおよび手法の継続的な改善に貢献する。 ■設計仕様、手法、および結果を明確かつ簡潔にドキュメント化する。

Chip Implementation EDA Flow 開発エンジニア

職種/業界
電気回路設計 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市 他

Chip Implementation EDA Flow 開発エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■チップ実装EDAフローの有効化(Enablement) ・サインオフ・フローの開発: RC抽出、タイミング解析、タイミング修正のためのサインオフ・フローを開発・最適化し、チップの性能と信頼性を確保する。 ・EDAプラットフォームの開発: 各設計工程の統合、デザインキットの管理、設計データベースの監視を行うEDAプラットフォームを開発・保守し、設計者が効率的に作業できる環境を構築する。 ・汎用CAD/EDA開発: 設計プロセスにおけるボトルネックを解消するため、各種設計課題を解決するEDAツールの開発・改善を行う。 ■設計チームと連携し、フローやツールに対するニーズの特定および要件定義を行う。 ■EDAベンダーと協力し、新機能の導入や既存ツールの最適化を図る。 ■開発したフローやツールの導入支援、ユーザーサポート、トラブルシューティングを行う。 ■最新のEDA技術や業界トレンドを常に把握し、社内フローへの適用可能性を評価する。 ■開発したフローおよびツールに関するドキュメントの作成と維持。

DFTエンジニア

職種/業界
電気回路設計 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市 他

2nm世代以降の最先端半導体プロセス技術の開発を支援する「イネーブルメント・チーム」に所属いただきます。次世代製造プロセスの検証に不可欠な、大規模テストチップのDFT(Design-for-Test:テスト容易化設計)実装をリードしていただきます。 【具体的には】 スキャン挿入、ATPG(自動テストパターン生成)、メモリBIST(自己診断テスト)などの手法を駆使し、歩留まり解析やEDAツールベンダーとの連携を通じて、設計品質とテスト効率の向上を目指していただきます。 ・アーキテクチャ設計:テストチップ向けのDFTアーキテクチャ(スキャン、バウンダリスキャン、メモリBIST)の定義と実装 ・検証:実装したDFT回路の機能・タイミング検証、シミュレーションによるテストカバレッジの評価 ・最適化:テストカバレッジ、コスト、時間のバランスを分析し、最適なテストソリューションを提案 ・連携:RTL設計から物理実装に至るまで、設計チームと協力してDFT機能を統合 ・シリコン評価: ATPG/MBISTパターンの作成・検証、実チップ(シリコン)の立ち上げおよびデバッグ支援 ・解析: シリコンからのテストデータを分析し、系統的な問題を特定して歩留まり(イールド)を改善 ・EDA連携: ベンダーと協力し、先端プロセス向けDFTツールの評価と手法の改善

半導体測定ラボエンジニア

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

2nm世代の先端ロジック開発におけるデバイス測定業務を担っていただきます。 【具体的には】 ・半導体デバイスのI-V、 C-V、RF S-para、ノイズなどの電気的特性測定および解析業務 ・測定装置やシステムの調整・管理・保守 ・測定データの収集・解析・報告 ・チームメンバーと協力して測定ラボ装置のダウンタイム低減と効率良いラボ運営 下記に挙げる装置の一部または全部を扱える方を歓迎しています。(現在未経験だとしてもこれらに興味があり、将来的にこれらの専門性を身に着けて業務していただけるやる気のある方も大歓迎です。) ■半導体パラメータアナライザー ■パラメトリックテスター ■容量計 ■周波数カウンタ ■フルオートプローバー ■セミオートプローバー ■1/fノイズ測定器 ■熱雑音測定器 ■高周波プローブ ■ネットワークアナライザー

半導体パッケージ設計エンジニア <物理設計・TEG設計>

職種/業界
研究・開発 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

下記業務をご担当いただきます。 【具体的には】 アドバンスドパッケージ(2.5D/2.xD/3D等)におけるインターポーザやパッケージ基板の設計および開発のためのTEG設計を行っていただきます。また物理設計者の立場から設計フローの構築にも関与いただくポジションです。SiインターポーザではCD(Critical Dimension)測定、アライメント、オーバーレイなどのプロセス制御に必要な計測構造を、KERF(スクライブ)領域内に配置するための構造設計およびレイアウト開発業務もございます。

半導体材料エキスパート

職種/業界
研究・開発 / 半導体
年収
600万円~1,200万円
勤務地
北海道千歳市

■2nm世代、及びBedyond 2nmの先端ロジック開発に必要な新規材料の評価/選定や新規材料を用いたプロセス開発、既存材料を用いたプロセス最適化など半導体材料に関連する多岐にわたる業務を担っていただきます。 【具体的には】 ・新規材料を用いたプロセス開発、既存材料を用いたプロセス最適化による性能・歩留まり向上 ・材料メーカーや装置メーカーとの協業による新規材料開発、新規材料を用いたプロセス開発 ・材料特性評価、信頼性確保、量産移行に向けた課題解決

データ基盤担当エンジニア

職種/業界
生産技術 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

半導体製造の前工程・後工程における製造ラインを支援するデータ基盤の構築・保守を担当いただきます。 ・装置やセンサーからのデータ収集・蓄積 ・データウェアハウス/データレイクの設計・構築・運用 ・外部システムへのデータ提供(API連携、ETL処理など) ・製造現場のニーズに応じたデータ基盤の改善・最適化

歩留解析・設備保全システム担当エンジニア

職種/業界
生産技術 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

半導体製造の前工程・後工程における製造ラインを支援する歩留解析システムおよび設備保全システムの導入・テスト・保守業務を担当いただきます。 ・歩留解析・設備保全システムの導入・構築 ・システムのテスト・運用・保守対応 ・製造現場からの要望に基づく改善提案・機能追加 ・データ解析ツールを活用した歩留まりや設備状態の分析支援

FA自動化エンジニア

職種/業界
生産技術 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

半導体製造の前工程・後工程における製造ラインの自動化を推進するFA(Factory Automation)エンジニアとして、以下の業務を担当いただきます。 ・設備メンテナンスの自動化設計・導入 ・工程ラインの自動化に向けたロボット・搬送・制御システムの設計・構築 ・FA推進リーダーの指示のもと、システムの導入・テスト・評価 ・製造現場との連携による要件定義・改善提案

ソフトウェア開発エンジニア

職種/業界
生産技術 / 半導体
年収
400万円~1,200万円
勤務地
北海道千歳市

◆職務内容 半導体製造の前工程・後工程における製造ラインを支援する製造実行システム(IBM SiView)のカスタマイズ開発を担当いただきます。 ・IBM SiViewの機能拡張・カスタマイズ ・Webベースのユーザーインターフェースの設計・開発 ・周辺システムとのインテグレーション(API連携、データ連携など) ・製造現場のニーズに応じたソフトウェアソリューションの提案・実装

デバイス開発用TEG設計マネージャ

職種/業界
研究・開発 / 半導体
年収
1,000万円~1,200万円
勤務地
北海道千歳市

■同社にて、下記業務を担当していただきます。 【具体的には】 ・2nm世代、及びBeyond 2nmの先端ロジック開発におけるTEG設計の全体管理を担当し、チームを率いてTEG設計方針を決め開発を推進 ・部門内エキスパート及び他部門(デバイス、TCAD、プロセスインテグレーション、ビッグデータ解析、PDK、パッケージング、開発企画)との密な連携を図り、開発を確実に遂行しつつ、技術ロードマップの策定、スケジュール管理、予算管理を行い、プロジェクトを円滑に進行 ・DTCOやIIMで生成される数々のインラインデータを基にしたData driven learning iterationとの相乗効果を生みながら、より高度な2nm世代、及びBeyond 2nm世代の技術開発基盤を支える創造的TEG設計を指揮

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