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■同社にて、下記業務を担当していただきます。 【具体的には】 ・MPW（シャトルロット）の企画・運用・スケジュール管理 ・設計顧客（ファブレス、研究機関等）との技術・進行調整窓口 ・社内プロセス改善、MPWサービスの高度化提案 【MPWとは】 MPW（Multi-Project Wafer）、別名シャトルロットは、半導体製造において「1枚のシリコンウェハを複数のユーザーやプロジェクトでシェアして製造する方式」を意味します。通常、半導体の製造には膨大なコスト（特に回路を転写するための「マスク」代）がかかりますが、これを「相乗り」することで1社あたりの負担を抑える仕組みです。 ※定期的に運行され、複数の乗客（設計データ）を乗せて目的地（物理的なチップ化）へ運ぶ様子が、定期便のバスや宇宙船の「シャトル」に似ていることから上記のように呼ばれています。
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■事業部門のパートナーとして、人事戦略の企画・実行を担いながら、中途採用業務を中心に推進いただきます。 【具体的には】 ・事業戦略に基づく採用計画の策定・実行 ・各部門との採用要件定義、ポジション設計、組織づくりについてのディスカッション ・採用チャネル選定、求人票作成、媒体管理 ・エージェントマネジメント、候補者との折衝 ・面接プロセス設計・運営、クロージング対応 ・採用データ分析、採用プロセス改善 ・HRBPとしての人事課題抽出、組織開発施策の提案・実行 ・採用チームのメンバーマネジメント ・採用から入社、入社式までのプロジェクトマネジメント業務 ・新しい取り組みのPJTオーナー
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デジタルチップ設計エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■標準セルおよびDTCOの推進 ・最先端テクノロジーノード向けの標準セルライブラリの設計、評価、および最適化。 ・DTCO（Design Technology Co-Optimization）活動の計画と実行。回路設計とプロセス技術の連携を強化し、最適なPPA（電力・性能・面積）ターゲットを達成する。 ・カスタムレイアウト、キャラクタライゼーション（特性評価）、および検証フローの開発と改善。 ・設計ルール、プロセスばらつき、および信頼性要件を深く理解した上での設計業務。 ■設計チーム、プロセス・デバイス開発チーム、およびEDAチームと緊密に連携する。 ■PPA目標を達成するため、新しい設計手法やツールの評価および導入を行う。 ■IPベンダーやEDAベンダーとの技術的な協議およびコラボレーション。 ■設計データのドキュメント化および維持管理。
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テストチップ設計エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■テストチップの物理設計およびPPA解析 ・バックエンド（BE）実装および関連フローの開発：チップレベルのプランニング、PG（電源／接地）ネットワーク設計から、フロアプラン、配置（Place）、CTS（クロックツリー合成）、配線（Route）、電力解析（PDNAサインオフ）、および包括的な物理検証まで、バックエンド実装フロー全体を推進する。 ・設計手法およびEDAツール・ユーティリティの開発：バックエンド実装に特化した設計手法と、関連するEDAツールのユーティリティを開発・強化する。これには、新しいプロセス技術から生じる課題へのソリューション作成や、顧客を効果的にサポートするためのユーティリティ開発が含まれる。 ・テクノロジー・ベンチマーク：詳細なテクノロジー・ベンチマークを実施し、新しいプロセス技術のPPA特性を徹底的に理解・評価する。 ■プロセス開発チーム、回路設計チーム、およびEDAベンダーと緊密に連携し、堅牢な設計フローを定義・実装する。 ■タイミング、電力、物理検証のエラーを含む、複雑な物理設計上の問題を分析しデバッグする。 ■設計プロセスおよび手法の継続的な改善に貢献する。 ■設計仕様、手法、および結果を明確かつ簡潔にドキュメント化する。
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Chip Implementation EDA Flow 開発エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■チップ実装EDAフローの有効化（Enablement） ・サインオフ・フローの開発: RC抽出、タイミング解析、タイミング修正のためのサインオフ・フローを開発・最適化し、チップの性能と信頼性を確保する。 ・EDAプラットフォームの開発: 各設計工程の統合、デザインキットの管理、設計データベースの監視を行うEDAプラットフォームを開発・保守し、設計者が効率的に作業できる環境を構築する。 ・汎用CAD／EDA開発: 設計プロセスにおけるボトルネックを解消するため、各種設計課題を解決するEDAツールの開発・改善を行う。 ■設計チームと連携し、フローやツールに対するニーズの特定および要件定義を行う。 ■EDAベンダーと協力し、新機能の導入や既存ツールの最適化を図る。 ■開発したフローやツールの導入支援、ユーザーサポート、トラブルシューティングを行う。 ■最新のEDA技術や業界トレンドを常に把握し、社内フローへの適用可能性を評価する。 ■開発したフローおよびツールに関するドキュメントの作成と維持。
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2nm世代以降の最先端半導体プロセス技術の開発を支援する「イネーブルメント・チーム」に所属いただきます。次世代製造プロセスの検証に不可欠な、大規模テストチップのDFT（Design-for-Test：テスト容易化設計）実装をリードしていただきます。 【具体的には】 スキャン挿入、ATPG（自動テストパターン生成）、メモリBIST（自己診断テスト）などの手法を駆使し、歩留まり解析やEDAツールベンダーとの連携を通じて、設計品質とテスト効率の向上を目指していただきます。 ・アーキテクチャ設計：テストチップ向けのDFTアーキテクチャ（スキャン、バウンダリスキャン、メモリBIST）の定義と実装 ・検証：実装したDFT回路の機能・タイミング検証、シミュレーションによるテストカバレッジの評価 ・最適化：テストカバレッジ、コスト、時間のバランスを分析し、最適なテストソリューションを提案 ・連携：RTL設計から物理実装に至るまで、設計チームと協力してDFT機能を統合 ・シリコン評価： ATPG／MBISTパターンの作成・検証、実チップ（シリコン）の立ち上げおよびデバッグ支援 ・解析： シリコンからのテストデータを分析し、系統的な問題を特定して歩留まり（イールド）を改善 ・EDA連携： ベンダーと協力し、先端プロセス向けDFTツールの評価と手法の改善
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2nm世代の先端ロジック開発におけるデバイス測定業務を担っていただきます。 【具体的には】 ・半導体デバイスのI-V、 C-V、RF S-para、ノイズなどの電気的特性測定および解析業務 ・測定装置やシステムの調整・管理・保守 ・測定データの収集・解析・報告 ・チームメンバーと協力して測定ラボ装置のダウンタイム低減と効率良いラボ運営 下記に挙げる装置の一部または全部を扱える方を歓迎しています。（現在未経験だとしてもこれらに興味があり、将来的にこれらの専門性を身に着けて業務していただけるやる気のある方も大歓迎です。） ■半導体パラメータアナライザー ■パラメトリックテスター ■容量計 ■周波数カウンタ ■フルオートプローバー ■セミオートプローバー ■1／fノイズ測定器 ■熱雑音測定器 ■高周波プローブ ■ネットワークアナライザー
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下記業務をご担当いただきます。 【具体的には】 アドバンスドパッケージ（2.5D／2.xD／3D等）におけるインターポーザやパッケージ基板の設計および開発のためのTEG設計を行っていただきます。また物理設計者の立場から設計フローの構築にも関与いただくポジションです。SiインターポーザではCD（Critical Dimension）測定、アライメント、オーバーレイなどのプロセス制御に必要な計測構造を、KERF（スクライブ）領域内に配置するための構造設計およびレイアウト開発業務もございます。
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■事業部門のパートナーとして、人事戦略の企画・実行を担いながら、新卒採用業務を中心に推進いただきます。 【具体的には】 ・事業戦略に基づく採用計画の策定・実行 ・各部門との採用要件定義、ポジション設計、組織づくりについてのディスカッション ・学校、官公庁などの関係者への訪問、調整、交渉等 ・採用チャネル選定、求人票作成、媒体管理 ・エージェントマネジメント、候補者との折衝 ・面接プロセス設計・運営、クロージング対応 ・採用データ分析、採用プロセス改善 ・HRBPとしての人事課題抽出、組織開発施策の提案・実行 ・採用チームのメンバーマネジメント ・採用から入社、入社式までのプロジェクトマネジメント業務 ・新しい取り組みのPJTオーナー
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下記いずれかをご担当いただきます。 【具体的には】 【1】チップレット技術の実現に不可欠な高速インターフェイス（HBM、UCIe、SerDesなど）に関する、アドバンスドパッケージの設計技術を開発していただきます。 【2】チップレット技術の実現に不可欠な高速インターフェイス（HBM、UCIe、SerDesなど）のPHY開発において、パッケージ仕様提案を行って頂きます。 【3】アドバンスドパッケージ（2.5D／2.xD／3D等）に関し、実測と解析のコリレーションを取り電気的な設計ライブラリ整備を行って頂きます。 上記の実務経験がなくても、入社してからOJTを通じて経験を積んで頂きます。
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■以下部署の業務の中から、これまでのご経験・適性やご希望に応じて配属・担当業務が決定となります（選考プロセスの中でご希望をお知らせください）。 【具体的には】 ・日次業務（仕訳・伝票処理、会計システムへの入力業務） ・出納関連業務（預金管理業務、支払処理業務、買掛金未払金管理業務） ・単体決算業務（月次・四半期・年次単体決算業務、計算書類作成、決算報告資料の作成、勘定科目内訳書の作成） ・税務業務（法人税・消費税等の申告業務） ・会計監査対応 ・内部統制の整備 ・NEDO関連業務 【働き方】 フレックスタイム：フルフレックス 在宅勤務：可能ですが原則出社 ※同社では現状各メンバーともほぼ出社しているものの、ご事情に応じて柔軟な対応をしています 残業時間：平均30-40時間／月、今後増員することで減らす予定 出張：千歳に月1回程度、1回あたり1,2泊 【組織構成】部長以下41名、うち正社員12名、派遣社員29名
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■財務（担当～シニアマネージャー）として下記業務を担当していただきます。 【具体的には】 ・財務企画（経営の意思決定に資する情報の収集と企画立案） ・コーポレートファイナンス（エクイティファイナンス／デットファイナンス）の企画立案、実行、社内外関係者との折衝 ・各種ステークホルダー（銀行、証券会社、官公庁、監査法人、株主、投資家等）とのコミュニケーション ・資金管理（キャッシュフローの最適化、財政状況の維持） ・為替管理（為替エクスポージャーの管理と為替リスクヘッジ等） 【求人の魅力】 ・国内最大級の資金調達に携わり、日本を背負う産業に関わるチャンスです。 ・上場を展望した財務管理体制の起ち上げをはじめ、政府・民間企業からのエクイティ調達やメガバンクはじめとした金融機関からのデットによる大型資金調達など、日本国内では稀有な財務経験を積むことができるオポチュニティです。
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■事業拡大と組織成長を支える人事制度・組織運営の企画立案から実行まで幅広く携わっていただきます。 ※経営層と連携し、人事領域全般の方針策定から運用まで、一貫して関与していただく予定です。業務はご経験や習熟度に応じて段階的に担当いただきます。 【具体的には】 ・経営層・部門責任者との連携による人事戦略の策定 ・人事制度（等級・評価・報酬）の企画・設計、制度改定プロジェクトの推進 ・評価・報酬制度の運用・改善の実施 ・事業計画に基づく組織設計・人員計画の立案および各部門との調整 ・従業員サーベイの設計・分析、エンゲージメント向上施策の企画・実行 ・経営者報酬や株式報酬に関わる制度設計、資料作成・情報管理 ・有価証券報告書等の人事関連情報開示に伴うデータ整理・管理および開示資料の作成
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■次世代半導体製造拠点の建設に伴う工事調達業務を担当いただきます。 【具体的には】 ・建設工事（建屋、ユーティリティ、クリーンルーム等）の調達戦略立案と実行 ・建設会社、施工業者との契約交渉・管理 ・工事仕様書・見積書の精査および技術的評価 ・工事スケジュール・コスト・品質の管理支援 ・社内関係部門（施設、製造、環境安全など）との連携による調達プロセスの推進 ・サプライヤー評価およびリスク管理 【勤務地に関して】 勤務地は千歳もしくは麹町で、麹町勤務の場合は千歳への出張が発生します
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■千歳工場（IIM）の建設プロジェクトにおいて、機械設備（ユーティリティ・製造支援設備）の設計・施工・立ち上げ業務を担当いただきます。 【具体的には】 現在IIM-1を建設中ですが、今後更にIIM-2,3,4を建設予定のため、継続的に業務が発生します。 ・半導体工場における機械設備（空調、熱源、コンプレッサー等）の設計・仕様検討 ・EPC業者・施工会社との技術折衝・進捗管理 ・工事計画の立案・施工管理・安全管理支援 ・設備導入に伴う試運転・性能確認・立ち上げ支援 ・社内関係部門（製造、施設、環境安全、品質など）との調整 ・NEDO等の外部機関への技術報告支援（必要に応じて）
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■千歳工場における機械設備の運用・改善・保全業務を担当いただきます。 【具体的には】 建設フェーズから量産フェーズへの移行に伴い、安定稼働と効率的な設備管理を実現するための技術支援を行っていただきます。 現在IIM-1を建設中ですが、今後更にIIM-2,3,4を建設予定のため、継続的に業務が発生します。 ・空調、熱源、コンプレッサーなどのユーティリティ設備の運用・改善 ・設備の稼働状況・保全履歴の管理と予防保全の推進 ・設備トラブルの原因分析・対策立案・再発防止活動 ・建設・施工フェーズにおける技術支援（仕様確認、試運転、性能評価など） ・EPC業者・保守業者との技術折衝・契約管理 ・製造部門・環境安全部門との連携による設備改善提案
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同チームのメンバーとして、多様な設計ニーズを持つ顧客がAI（人工知能）アプリケーション向けの製品を実現できるよう、業界最先端のプロセス技術の共同最適化（Co-optimization）の最前線に立っていただきます。コンパクトモデリング・チームは、プロセス開発チームとの設計インターフェースとしての役割を果たし、すべての新しい同社プロセスにおいて、設計とプロセスの主要な相互作用を構築しています。 【具体的には】 高度にインタラクティブなチーム環境において、多様な回路設計環境下でシリコン性能を極めて正確に再現するため、SPICEレベルのシミュレーションに向けた各種デバイスモデルのソフトウェア開発および維持管理を行っていただきます。 ・同社のPDKでサポートされている業界標準の回路シミュレーションツールにおいて、コンパクト／SPICEデバイスモデルのコードおよび方程式の開発・維持管理。 ・モデルパラメータ抽出、新技術開発、およびシリコンプロセス制御モニター（PCM）のためのテスト構造の開発・維持管理。 ・技術開発チームおよびEnablementチームと密接に連携し、高品質なモデルを提供。
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同社オフィスや工場（IIM）、データセンター、各拠点を結ぶネットワークおよび、インフラ基盤を構成する各種サーバの運用管理をご担当いただきます。 【具体的には】 ■ネットワーク機器の運用及び管理、障害対応、ユーザサポート。管理機器は、L2/L3 Swich/Router/Firewall/IPS/IDS/その他アプライアンス。 ■インフラサーバ機器の運用及び管理、障害対応、ユーザサポート。管理対象は、VDIサーバ/Proxyサーバ/バックアップサーバ/Syslogサーバ。 ■物理ファシリティの運用及び管理、障害対応、ユーザサポート。管理対象は、ラック/ケーブル/PDU/電源/空調/セキュリティ機器。 ■各協力会社のマネージメント ■新規製品・サービスの選定や導入 ■運用オペレーションフローの立案、ルール策定、各種ドキュメント作成 ■各種トラブルシューティング（不具合調査、協力会社と連携して対応方針の決定）
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2nm世代、及びBeyond 2nmのLSIを設計するためのPDK開発の業務を担っていただきます。以下のいずれかの業務を担っていただきます。 【具体的には】 ・PcellおよびSchematic Symbolの開発、サポート ・物理検証（DRC、 LVS、 ERC、 PERC）ルールの開発、サポート ・寄生素子抽出（LPE）ルールの開発、サポート ・DRM（Design Rule Manual）の開発、サポート ・EMIR（Electro Migration、 IR drop）ルールの開発、サポート ・カスタムレイアウトのオートメーション技術開発、サポート 【使用ツール】 Virtuoso、Spectre、 Voltus-Fi、 Pegasus、Quantus、 Custom Compiler、 HSPICE、ICV、StarRC、Calibre Family等
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半導体テストチップのレイアウトDesign及び、プロセスのPPA評価用レイアウトDesignを担当していただきます。 【具体的には】 EDAツールを使ったディジタル設計全般についてRTLからテープアウトまでを実施していただきます。また、タイミング収束、物理検証、IRdrop／EM検証などのデザイン収束にかかわる業務も担当していただきます。設計業務に関連してTCL言語、SKILL言語、その他の言語にてスクリプト作成をして頂きます。また、新たに構築する設計フローに対するトライアル、ツール動作検証、改善提案業務などを担当して頂きます。ジョブローテーションが頻繁にありますので、re-skilling能力が重視されます。
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半導体テストチップのレイアウトDesign及び、プロセスのPPA評価用レイアウトDesignを担当して頂きます。マニュアルでのレイアウトの他に、TCL言語、SKILL言語、その他の言語でスクリプト作成してレイアウト作業をして頂きます。 【具体的には】 先端プロセスのFEOL・BEOLレイアウトルールを理解し、カスタムセル設計可能なレベルのスキルを身に着けて頂く必要があります。また、新たに構築する設計フローに対するトライアル、ツール動作検証、改善提案業務などを担当して頂きます。ジョブローテーションが頻繁にありますので、re-skilling能力が重視されます。
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■半導体製造（前工程・後工程いずれか）のマネジメントを担っていただきます。現場の安定稼働・品質向上・人材育成・工程改善など、製造部門の中核として活躍することが期待されています。 【具体的には】 ・製造部門の統括管理（人員配置、工程管理、設備管理）：原価管理、量産用・試作用のロット手配、振出手配、生産活動の運営（チョコ停対策、産業廃棄物の出荷・処理依頼と管理等 ・製造課長・現場リーダーとの連携による業務推進 ・生産性向上・歩留まり改善・品質安定化のための施策立案・実行 ・製造工程の改善活動（QCサークル、5S、カイゼン活動など） ・製造関連規程・標準書の整備と運用 ・安全衛生管理の推進 ・他部門（技術、品質保証、営業など）との連携・調整 ・部門社員の育成・評価・指導
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下記業務をご担当いただきます。 【具体的には】 ・Fill：チップ上でより均一なパターン密度を作成するために使用されるダミー形状の仕様の作成とコーディング、及びFillセル設計を担当いただきます。 ・Retargeting：下流のマスク作成に使用される最終的なウェーハ寸法に合わせて設計形状を変更するコードを作成する責任を負っていただきます。 ・Kerf： CD（Critical Dimension 測定、アライメント、オーバーレイ、その他の計測要件などのプロセス制御ニーズのために工場で使用される KERF （またはフレーム／スクライブ） 内のマクロを作成する責任を負っていただきます。 KERF エンジニアは、配置制約の対象となる領域内にこれらの個別マクロを配置するための自動化のためのコード作成も行っていただきます。 ・Mask Release：マスク作成に関するスケジュールを調整し、後処理されたデータをマスク製造用のマスクメーカーに転送する責任を負っていただきます。 マスクセット全体の購買管理もしていただきます。
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■カンパニー（事業部）の人事担当者として、以下の想定業務を入社後のスキルアップに応じて、部分的・段階的に担当いただきます。 【具体的には】 ・事業部門の人事戦略立案・実行：事業部門の経営戦略と連携し、中長期的な人財戦略（People Strategy）の策定と実行 ・組織マネジメント・組織開発：HRBP組織における人材開発とマネジメント ・人事制度の企画・構築・運用：労働法規制に基づいた労働条件や労働時間の管理、福利厚生制度の策定と運用、評価制度の設計と導入などを行う ・要員管理・勤怠管理システムの運用・改善：従業員の勤怠管理や休暇管理、出退勤管理のシステムを運用し、必要に応じて改善する ・労務費管理と予算策定：人件費予算の策定・管理、給与計算や社会保険手続きなどの労務費管理を行い、予算の適正な活用を図る ・人材育成・教育プログラムの企画と実施：従業員のスキルアップやキャリアパスの構築をサポートするための教育プログラムや研修の企画と実施を行う ・労務厚生の企画立案と実行：社内福利厚生制度の企画と導入、労働環境の改善、従業員の健康管理などの労務厚生に関する企画立案と実行を行う ・従業員満足度向上のためのアクションプランの策定と実行：アンケート調査やフィードバックを基に、従業員の満足度向上のためのアクションプランを策定し、実行を推進する ・HRデータの分析とレポート作成：人事関連データや人材動向の調査分析を行い、経営層に向けたレポート作成や戦略立案を行う ・従業員の労務トラブルや問題解決のサポート：労働条件や労働法規制に関するトラブルや問題に対して、従業員や経営層をサポートし解決策を提案する
AIサーバー・データセンター向け高性能SSDの心臓部となる、コントローラSoCのアーキテクチャ設計および性能検証を担当いただきます。チップ実装設計に先立ち、ハードウェアとファームウェアの最適な役割分担を定義し、製品性能を最大化させる最上流の「論理的設計指針＝アーキテクチャ設計」に挑戦可能です。 【具体的な仕事内容】 ■SoCアーキテクチャの論理定義と最適化：SoCの論理設計を行うHW設計チーム、SoCに搭載する制御ソフト設計を行うFW設計チームと連携した、コントローラのアーキテクチャ設計開発 ■シミュレーションモデルの開発・実装：SystemC／C++等を用い、SoC内部の複雑な挙動を高度に再現する、高精度な性能シミュレーションモデルの設計・実装 ■性能評価およびボトルネックの解析・解消：構築した性能シミュレーションモデルを用い、データ転送の停滞箇所を定量的・論理的に特定。解析結果に基づき、性能目標達成に向けた仕様変更の具体的な方針を提示 ■HW／FW実装仕様への要件落とし込みと整合：検証結果に基づき、HW（回路設計）およびFW（制御ソフト開発）の両チームと実装レベルでの仕様整合（アライメント）を行い、実機における目標性能の達成を実現 【業務のやりがい】 SSDは弊社の主力製品で、生成AI需要に伴い、急速に事業拡大しています。担当製品が認められ、事業が拡大し、世の中が変わっていく様を一緒に作っていくことが可能です。SSDアーキテクチャ開発は、どのような技術を導入すれば世の中から求められているものを実現できるかを考える取り組みであり、自分達のアイデアが製品のコアになっていくことは魅力です。 【使用ツール】 ◇言語：C++, Python ◇ツール：波形ビューワー, データ分析ツール（Spotfire等） ◇開発環境：Linux, LSF, GNU開発ツールチェイン
下記業務をご担当いただきます。 【具体的には】 ■3次元メモリ向け新規技術の研究開発：新たなメモリ構造やデバイスコンセプトの先行開発を行います。物理的限界を打破するための技術探索を行っていただきます。 ■プロセスフローの設計・実装・検証・改善提案：考案したデバイス構造を具現化するため、成膜、リソグラフィ、エッチングなど製造工程を組み合わせ、最適なプロセスフローを設計いただきます。 ■量産適用に向けた技術移管支援：開発した最新技術を、四日市工場などの大規模量産ラインへスムーズに導入するための調整・支援を行っていただきます。 ■デバイス特性評価（電気特性、信頼性試験）および解析：試作ウェハーの電気特性や信頼性の測定・解析を行い、測定データから構造上の課題や物理現象を突き止めます。 ■製造・設計・材料開発部門との連携による開発推進半導体開発は多岐にわたる専門技術の集合体であるため、回路設計、材料開発、装置エンジニアなどの各部門と連携します。 ■技術動向の調査および社内外への技術報告：国内外の学会や論文から最新の技術トレンドを調査し、開発戦略に反映させます。社内報告や特許出願、学会発表なども行います。 ■3Dメモリの設計・解析・最適化業務：デバイスシミュレータ（TCAD）を用い、実際の試作前にデバイス構造や製造条件の最適化を行います。物理モデルに基づいた予測を行うことで、開発期間の短縮と高精度な設計を実現します。
次世代の3Dメモリに向けた新規技術の研究開発を担当いただきます。新たなブレークスルー技術の探索、設計、試作、検証を通して、さらなる大容量化・高性能化の実現を実感できるチャレンジングな業務です。 【具体的には】 ■3Dメモリ向け新規技術の研究開発 ■プロセスフローの設計・実装・検証・改善提案 ■量産適用に向けた技術移管支援 ■デバイス特性評価（電気特性、信頼性試験）および解析 ■製造・設計・材料開発部門との連携による開発推進 ■技術動向の調査および社内外への技術報告 ■TCADを活用した、3Dメモリの設計・解析・最適化業務 ※これまでのご経験にあわせて、同社の研究開発で生かせるポジションを選考の中でご提案いただきます。
経験に応じて、シミュレーションを活用した先端メモリデバイス、新規プロセスの研究開発業務、シミュレーション技術の標準化と社内展開業務、シミュレーション技術そのものの研究開発業務を担当いただきます。 【具体的には】 ・形状シミュレータを活用した3次元的レイアウト・プロセスのフィージビリティススタディ ・応力／熱シミュレータを活用した3次元的メモリ構造・プロセスのフィージビリティスタディ ・プラズマ／物理化学シミュレータを活用した新規プロセスの研究開発 ・プロセス／デバイスシミュレータ(TCAD)を活用した次世代メモリデバイス／配線の研究開発 ・各種シミュレーション技術の高速化／高精度化についての研究開発 ・各種シミュレーション技術の標準化と社内展開推進 【使用ツール】 Python, C/C++ Windows/Linux環境 Microsoft Office (Outlook/Word/PowerPoint/Excel) Synopsys Sentaurus/Ansys, Lam Research SEMulator3Dなどのプロセス・デバイスシミュレータ VASP, PAHSEなどの第一原理計算ツール Matlantis/LAMMPSなどの分子動力学シミュレータ
■同社にて、以下の業務をご担当いただきます。 【具体的には】 ＜メイン業務＞ ・SoC開発のマネジメント(PM) および SoC開発業務全般 (sub-PM) 担当業務：SoC開発のプロジェクトマネジャー / ファシリテーター ｰ プロジェクトの目的を明確にし、計画を立案する - プロジェクトチームを編成する - 開発チームおよび全体のQCDを管理し、プロジェクトを計画通りに進める - 顧客に対して進捗報告、変更に対する折衝などを行いながら、良好な関係を維持する - 開発の進捗状況と課題を把握し、顧客に報告する - プロジェクト内の調整を行い、進捗、課題の解決に努める ＜サブ業務＞ ・プロジェクトマネジメント手法の改善、後進の育成 【将来のキャリアパス】 ・上位プロジェクトマネジメントとして複数プロジェクトを管理、プロマネ組織の管理者 ・プロダクトマネジャー(事業部門で、開発だけでなく、プロダクトの事業全体を管理)
【職務内容】 最先端メモリデバイス開発における微細加工や成膜工程のプロセス、装置改善業務、要素開発業務を担当していただきます。 【担当工程】※いずれかの工程を担当していただきます ドライエッチング／ウェットエッチング（洗浄）／CMP（平坦化）／PE-CVD／LP-CVD／Metal／Diffusion・イオン注入／リソグラフィ 【具体的には】プロセスエンジニアの業務は大きく分けると下記の3つとなります。 (1)次世代量産技術の確立：量産用新機種評価。生産コスト低減など (2)微細化製品の量産化：量産設備導入立ち上げ、新製品生産レシピ条件と運用決定、歩留り改善 (3)量産プロセス安定化：マージン評価、工程能力向上、新機種/号機間ばらつき改善 品質、コスト、生産性の改善を目的とした量産化技術の開発、設備・プロセス立ち上げ業務に従事して頂きます。 【ポジションの魅力】 ■技術を極めることが出来ます：プロセスエンジニアは、上記のいずれかの工程を担当し、その工程の技術を深め、技術レベルの向上に注力頂きます。 ■視野を広げることが出来ます：半導体ビジネスの観点で、いかに利益を上げるかという視点を持つことが重要です。そのため、日々の業務を通じて、技術だけではなくビジネス感覚、視野の広さも手に入れることができます。
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■同社にて、下記業務を担当していただきます。 【具体的には】 ・半導体製品企画 ・半導体製品/応用装置における評価 ・デジタルマーケティング用技術コンテンツ企画、制作 ・営業技術業務 など 同部門は光絶縁デバイスの開発・提案業務を担っており、特に車載向け製品と、メカリレーから半導体リレー化に対応する製品に従事する技術者を募集しています。 1製品当たりの開発スパンは1年～1年半となり、製造技術部門、組立技術部門などと連携して開発を進めています。得意への提案では、営業部門、関係会社の営業技術部門、海外の現地法人とも連携しており、多くの関係部門とのコミュニケーションが重要となります。
光通信用半導体レーザのプロダクトラインマネジメント担当として、下記業務をご担当いただきます。 ※新製品のプロモーション、デザインイン獲得を行っていただきます。市場動向を調査し、それをロードマップに反映し、製品仕様の確認、交渉を行い、顧客認定を取得していただきます。 【具体的には】 ■新製品のデザインイン ・製品仕様書の作成と顧客との仕様交渉 ・顧客から新製品の認定（デザインイン）を獲得するための技術的サポート（製品の使い方、信頼性に関する技術的問合せに対応） ・データシート等の技術資料作成 ■PCN 及びPDN管理 ・製品仕様変更、廃止に関する連絡 ・現行品の最終販売時期、数量の確認
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■ディスクリート半導体（パワーMOSFET、IGBT等、小信号デバイス、汎用小型IC、アイソレーションデバイス・半導体リレー）に関する下記の業務を担当していただきます。 【具体的には】 ・デバイス設計・シミュレーション（TCA） ・試作・性能評価・解析 ・量産立上業務 【対象デバイス】 ※（）内は想定勤務地です。 ・IGBT、ダイオード、パワーモジュール（兵庫県揖保郡太子町／石川県能美市） ・アイソレーションデバイス・半導体リレー（福岡県豊前市） ・パワーMOSFET（石川県能美市） ・小信号デバイス。特にMOSFET（兵庫県揖保郡太子町） ・小信号デバイス。特に汎用小型IC（神奈川県川崎市）
■同社にて、製品テスト設計、テスト立ち上げ業務全般をご担当いただきます。 【具体的には】 ・SoC製品のテスト仕様策定、テスト戦略の検討 ・テスト仕様に基づくテストプログラム開発 ・LSIテスターを用いた実製品の評価、および量産化に向けた各種業務の推進 ●将来のキャリアパス ・まずはテストの専門エンジニアとして技術スキル・マネジメントスキルの向上・拡大を目指す ・適正に応じて、SoC製品のDFTやレイアウト設計、量産サポートなどの業務を経験頂く事も可能 ・将来的にはSoC製品の製品企画、商談対応、開発プロジェクトマネジメント推進などの業務推進可能性有 ・海外勤務(北米,欧州,台湾,中国など)も希望があれば可能
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■同社にて、以下の業務をご担当いただきます。 【具体的には】 ・プロジェクト成功へ向けた戦略立案、進捗管理等のプロジェクトマネジメント業務 ・日本及び海外顧客に対してプロジェクトステータス、トラブルシューティングプロセス、技術的な調査結果、及び事後分析レポートを現地言語若しくは英語を用いて行う報告業務、及び社内への報告 ・部門横断的なチームと緊密に連携しながら、メンバと共にプロジェクトで生じる技術的な問題解決を行う。 ・より良い方法を考え、作業手順改善活動を行う、またプロジェクト終了時には結果を振り返り、次プロジェクトへの反省及び対策を行う。 ・プロジェクトメンバ、プロジェクトコスト管理 ・デジタルレイアウト設計開発業務 ※プロジェクトによっては一部業務をご担当いただく場合もあります。 ●将来のキャリアパス ・日本/海外拠点でのデジタルレイアウト設計プロジェクトリーダー ・複数のデジタルレイアウト設計プロジェクトを統括する統括リーダー
■同社にて、以下の業務をご担当いただきます。 【具体的には】 ・デジタルレイアウト設計開発業務 ・プロジェクトステータス、トラブルシューティングプロセス、技術的な調査結果及び事後分析レポートの作成も行いプロジェクトメンバーへ報告する。また、顧客の現地言語若しくは英語を用いて直接顧客へ報告を行う場合あり。 ・部門横断的なチームと緊密に連携しながら、プロジェクトで生じる技術的な問題解決を行う。 ・より良い方法を考え、作業手順改善活動を行う、またプロジェクト終了時には結果を振り返り、次プロジェクトへの反省及び対策を行う。 ●将来のキャリアパス ・デジタルレイアウト設計チームリーダー ・日本/海外拠点でのデジタルレイアウト設計プロジェクトリーダー ・デジタルレイアウト設計における設計フロー開発担当
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