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5G／6G基地局向けGaN-HEMTデバイスに関する、トランジスタのモデリング技術開発または高周波回路の設計開発を担うポジションです。顧客が回路設計に利用するシミュレーションモデルの作成・提供、およびモデルを用いた高周波回路技術の開発を通じて、同社デバイスの市場競争力を支えていただきます。 【具体的には】 ・GaN-HEMTトランジスタのシミュレーションモデル開発 ・顧客向けシミュレーションモデルの作成・提供 ・高周波回路技術の開発 ・GHz帯の高周波特性評価・解析 ・数学を用いた計算・式作成・シミュレーション ■業務の特徴 ・モデリング・シミュレーションを担うチームに配属。顧客が製品を使いこなすための技術的な「翻訳者」の役割を担います。 ・デバイス設計やプロセス開発との連携を通じて、デバイスの物理からシステム応用までの広い視野が得られます。
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同社の先端パッケージング技術開発において、TSV（Through-Silicon Via）形成を中心としたRIE（反応性イオンエッチング）プロセスの開発・最適化を担当いただきます。装置評価からプロセス設計、量産立ち上げ支援まで、技術の中核を担うポジションです。 【具体的には】 ・TSV形成における深堀りRIEプロセスの開発・条件最適化 ・シリコン、絶縁膜、バリア層などの選択的エッチング技術の検討 ・プラズマエッチング装置の選定・立ち上げ・評価 ・エッチング後の形状評価（SEM、CD測定、プロファイル解析） ・製造・パッケージング部門との連携によるプロセスインテグレーション支援 ・装置メーカーとの技術折衝・共同開発
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同社の先端半導体製造において、露光機のレシピ・アプリケーションを活用し、リソグラフィプロセスの精度・性能向上を推進する技術開発業務を担当いただきます。装置メーカーとの連携や工程改善を通じて、歩留まり・生産性の向上に貢献していただきます。 【具体的には】 ・露光機（ArF、EUV等）のレシピ開発・最適化（アライメント、フォーカス、ドーズ、マスク補正など） ・リソグラフィ工程の精度・安定性向上に向けたアプリケーション活用 ・CD・Overlay・Focus等のプロセスウィンドウ評価・改善 ・装置メーカーとの技術折衝・共同検討 ・プロセスデータの収集・解析・フィードバック（JMP、Python等） ・製造・プロセス部門との連携による工程改善・歩留まり向上支援
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同社では、まだ日本で開発されていない2nmのロジック半導体を開発・製造を行っており、2027年からの量産を予定しています。 今ある技術を次の世代をと継承していくべく、長きにわたって活躍をいただきたいと考えています。 【業務内容】 あなたの専門知識やご経験、キャリア志向に基づき、DLオートメーション部の一員として、製造ITシステムの開発・導入をご担 当いただきます。 ▼製造実行システム（MES）を中心としたソフトウェア開発 MESのカスタマイズ開発: IBM社の半導体向けMESパッケージ「SiView」をベースに、同社の製造プロセスに合わせた機能追加や改修を行います。 Webアプリケーション開発: 製造データや装置状態を可視化し、現場のエンジニアやオペレーターの作業効率を向上させるための、WebベースのUI（ユー ザーインターフェース）を開発します。 システムインテグレーション: MESと、生産計画システム、品質管理システム、装置オンラインシステムといった多数の周辺システムを連携させるためのソフ トウェア開発を行います。
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同社の最先端半導体製造プロセスにおいて、Cu Dual Damascene構造の形成に関するエッチング技術開発を担当いただきます。プロセス開発から装置評価、量産立ち上げ支援まで、技術の中核を担うポジションです。 【具体的には】 ・Cu Dual Damascene構造に対応したエッチングプロセスの開発・最適化 ・プラズマエッチング装置の選定・条件設定・評価（ハードマスク、低k材料対応含む） ・微細パターン形成における選択性・異方性・ダメージ制御技術の検討 ・製造工程との連携によるプロセスインテグレーション支援 ・装置メーカーとの技術折衝・共同開発 ・プロセス安定性・再現性の評価および改善提案
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■半導体の生産技術・生産設備（インテグレータ）業務を担当していただきます。 【具体的には】 ・MEMS製品担当のインテグレータ ・CMOS製品担当のインテグレータ 【補足】 入社後すぐ在籍出向となり、出向元がミツミ電機株式会社、出向先はMMIセミコンダクター株式会社となります。（年収や待遇などは全社統一です） 【半導体事業部について】 同社半導体事業部は、アナログ半導体（パワー半導体を含む）を製造しており、自社ブランドの半導体開発から設計、製造まで一気通貫で行う事業と顧客の半導体を受託生産する事業（ファウンドリ）を行っています。 アナログ技術を活かす4つの製品領域で高精度・高速・高耐圧・小型化を追求しています。 （1）電池（リチウムイオン電池保護IC、電池残量予測IC、充電制御IC） （2）電源（システムリセットIC、LDO、DC/DCコンバータ、AC/DC電源用IC） （3）センサ（MEMSセンサ、温度／電流センサ、AFE/ADC） （4）IGBT & FRD（EV（自動車）、産機市場向けIGBT）
■同社の半導体事業部、MMIセミコンダクター株式会社にて、「MEMS開発（MEMSエンジニアもしくはICエンジニア）」として製品設計開発・MEMSデバイスの設計を担当していただきます。 【補足】 入社後すぐ在籍出向となり、出向元がミツミ電機株式会社、出向先はMMIセミコンダクター株式会社となります。（年収や待遇などは全社統一です） 【やりがい】 同社で開発生産するMEMSは、人々が生活する中で、携帯電話をはじめPCや家電など多種多様な用途で使用されます。 ミネベアミツミグループとなって開発に取りかかった新製品が続々とリリースされ、世の中で使われはじめており、そこにやりがいを感じることができます。 【半導体事業部について】 同社半導体事業部は、アナログ半導体（パワー半導体を含む）を製造しており、自社ブランドの半導体開発から設計、製造まで一気通貫で行う事業と顧客の半導体を受託生産する事業（ファウンドリ）を行っています。 アナログ技術を活かす4つの製品領域で高精度・高速・高耐圧・小型化を追求しています。 （1）電池（リチウムイオン電池保護IC、電池残量予測IC、充電制御IC） （2）電源（システムリセットIC、LDO、DC／DCコンバータ、AC／DC電源用IC） （3）センサ（MEMSセンサ、温度／電流センサ、AFE／ADC） （4）IGBT ＆ FRD（EV（自動車）、産機市場向けIGBT）
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■同社にて、下記業務を担当していただきます。 【具体的には】 ・2nm世代、及びBeyond 2nmの先端ロジック開発におけるTEG設計の全体管理を担当し、チームを率いてTEG設計方針を決め開発を推進 ・部門内エキスパート及び他部門（デバイス、TCAD、プロセスインテグレーション、ビッグデータ解析、PDK、パッケージング、開発企画）との密な連携を図り、開発を確実に遂行しつつ、技術ロードマップの策定、スケジュール管理、予算管理を行い、プロジェクトを円滑に進行 ・DTCOやIIMで生成される数々のインラインデータを基にしたData driven learning iterationとの相乗効果を生みながら、より高度な2nm世代、及びBeyond 2nm世代の技術開発基盤を支える創造的TEG設計を指揮
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■同社では、まだ⽇本で開発されていない2nmのロジック半導体を開発‧製造を⾏うために、北海道千歳市にIIMと呼ぶ最先端半導体⼯場の建設しています。2027年初頭に量産開始を予定しています。半導体の前⼯程から後⼯程、そして研究開発や量産技術の確⽴を⾏うため、共に⽇本の半導体産業を盛り上げる仲間を募集しています。 【具体的には】 ・2nm世代、及びBeyond 2nmの先端ロジック開発における主にフロントエンドの業務（TEGレイアウト設計含む）を担い、チーム全体のマネジメントを行っていただきます。 ・フロントエンドプロセス技術開発プロジェクトの管理を担当し、チームを率いてプロセス技術開発を推進していただきます。 ・社内他部門（デバイス、PDK、パッケージング、生産技術）や装置・材料メーカーとの密な連携を図り、開発成果を確実に遂行しつつ、技術ロードマップの策定、スケジュール管理、予算管理を行い、プロジェクトを効果的にに進行していただきます。
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テストチップ設計エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■テストチップの物理設計およびPPA解析 ・バックエンド（BE）実装および関連フローの開発：チップレベルのプランニング、PG（電源／接地）ネットワーク設計から、フロアプラン、配置（Place）、CTS（クロックツリー合成）、配線（Route）、電力解析（PDNAサインオフ）、および包括的な物理検証まで、バックエンド実装フロー全体を推進する。 ・設計手法およびEDAツール・ユーティリティの開発：バックエンド実装に特化した設計手法と、関連するEDAツールのユーティリティを開発・強化する。これには、新しいプロセス技術から生じる課題へのソリューション作成や、顧客を効果的にサポートするためのユーティリティ開発が含まれる。 ・テクノロジー・ベンチマーク：詳細なテクノロジー・ベンチマークを実施し、新しいプロセス技術のPPA特性を徹底的に理解・評価する。 ■プロセス開発チーム、回路設計チーム、およびEDAベンダーと緊密に連携し、堅牢な設計フローを定義・実装する。 ■タイミング、電力、物理検証のエラーを含む、複雑な物理設計上の問題を分析しデバッグする。 ■設計プロセスおよび手法の継続的な改善に貢献する。 ■設計仕様、手法、および結果を明確かつ簡潔にドキュメント化する。
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下記業務をご担当いただきます。 【具体的には】 ・Fill：チップ上でより均一なパターン密度を作成するために使用されるダミー形状の仕様の作成とコーディング、及びFillセル設計を担当いただきます。 ・Retargeting：下流のマスク作成に使用される最終的なウェーハ寸法に合わせて設計形状を変更するコードを作成する責任を負っていただきます。 ・Kerf： CD（Critical Dimension 測定、アライメント、オーバーレイ、その他の計測要件などのプロセス制御ニーズのために工場で使用される KERF （またはフレーム／スクライブ） 内のマクロを作成する責任を負っていただきます。 KERF エンジニアは、配置制約の対象となる領域内にこれらの個別マクロを配置するための自動化のためのコード作成も行っていただきます。 ・Mask Release：マスク作成に関するスケジュールを調整し、後処理されたデータをマスク製造用のマスクメーカーに転送する責任を負っていただきます。 マスクセット全体の購買管理もしていただきます。
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同チームのメンバーとして、多様な設計ニーズを持つ顧客がAI（人工知能）アプリケーション向けの製品を実現できるよう、業界最先端のプロセス技術の共同最適化（Co-optimization）の最前線に立っていただきます。コンパクトモデリング・チームは、プロセス開発チームとの設計インターフェースとしての役割を果たし、すべての新しい同社プロセスにおいて、設計とプロセスの主要な相互作用を構築しています。 【具体的には】 高度にインタラクティブなチーム環境において、多様な回路設計環境下でシリコン性能を極めて正確に再現するため、SPICEレベルのシミュレーションに向けた各種デバイスモデルのソフトウェア開発および維持管理を行っていただきます。 ・同社のPDKでサポートされている業界標準の回路シミュレーションツールにおいて、コンパクト／SPICEデバイスモデルのコードおよび方程式の開発・維持管理。 ・モデルパラメータ抽出、新技術開発、およびシリコンプロセス制御モニター（PCM）のためのテスト構造の開発・維持管理。 ・技術開発チームおよびEnablementチームと密接に連携し、高品質なモデルを提供。
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デジタルチップ設計エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■標準セルおよびDTCOの推進 ・最先端テクノロジーノード向けの標準セルライブラリの設計、評価、および最適化。 ・DTCO（Design Technology Co-Optimization）活動の計画と実行。回路設計とプロセス技術の連携を強化し、最適なPPA（電力・性能・面積）ターゲットを達成する。 ・カスタムレイアウト、キャラクタライゼーション（特性評価）、および検証フローの開発と改善。 ・設計ルール、プロセスばらつき、および信頼性要件を深く理解した上での設計業務。 ■設計チーム、プロセス・デバイス開発チーム、およびEDAチームと緊密に連携する。 ■PPA目標を達成するため、新しい設計手法やツールの評価および導入を行う。 ■IPベンダーやEDAベンダーとの技術的な協議およびコラボレーション。 ■設計データのドキュメント化および維持管理。
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Chip Implementation EDA Flow 開発エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■チップ実装EDAフローの有効化（Enablement） ・サインオフ・フローの開発: RC抽出、タイミング解析、タイミング修正のためのサインオフ・フローを開発・最適化し、チップの性能と信頼性を確保する。 ・EDAプラットフォームの開発: 各設計工程の統合、デザインキットの管理、設計データベースの監視を行うEDAプラットフォームを開発・保守し、設計者が効率的に作業できる環境を構築する。 ・汎用CAD／EDA開発: 設計プロセスにおけるボトルネックを解消するため、各種設計課題を解決するEDAツールの開発・改善を行う。 ■設計チームと連携し、フローやツールに対するニーズの特定および要件定義を行う。 ■EDAベンダーと協力し、新機能の導入や既存ツールの最適化を図る。 ■開発したフローやツールの導入支援、ユーザーサポート、トラブルシューティングを行う。 ■最新のEDA技術や業界トレンドを常に把握し、社内フローへの適用可能性を評価する。 ■開発したフローおよびツールに関するドキュメントの作成と維持。
■マネージャーの指導の元、製造現場における生産活動の管理・監督業務を担当していただきます。現場作業者・オペレーターとの連携を図りながら、品質・納期・安全の確保を推進していただきます。 【具体的には】 ・原価管理、量産用・試作用のロット手配、振出手配 ・生産活動の運営（チョコ停対策、材料振出手配、ロット手配（量産用、試作用）） ・産業廃棄物の出荷・処理依頼と管理 ・製造現場の作業者・オペレーターの管理・指導 ・生産計画の立案・進捗管理 ・品質管理活動（QCサークルの推進、工程改善など） ・作業標準書・規程書の整備・運用 ・安全衛生管理の実施 ・他部門（営業・技術・品質保証など）との連携・調整 ・現場課題の抽出と改善活動の推進
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2nm世代以降の最先端半導体プロセス技術の開発を支援する「イネーブルメント・チーム」に所属いただきます。次世代製造プロセスの検証に不可欠な、大規模テストチップのDFT（Design-for-Test：テスト容易化設計）実装をリードしていただきます。 【具体的には】 スキャン挿入、ATPG（自動テストパターン生成）、メモリBIST（自己診断テスト）などの手法を駆使し、歩留まり解析やEDAツールベンダーとの連携を通じて、設計品質とテスト効率の向上を目指していただきます。 ・アーキテクチャ設計：テストチップ向けのDFTアーキテクチャ（スキャン、バウンダリスキャン、メモリBIST）の定義と実装 ・検証：実装したDFT回路の機能・タイミング検証、シミュレーションによるテストカバレッジの評価 ・最適化：テストカバレッジ、コスト、時間のバランスを分析し、最適なテストソリューションを提案 ・連携：RTL設計から物理実装に至るまで、設計チームと協力してDFT機能を統合 ・シリコン評価： ATPG／MBISTパターンの作成・検証、実チップ（シリコン）の立ち上げおよびデバッグ支援 ・解析： シリコンからのテストデータを分析し、系統的な問題を特定して歩留まり（イールド）を改善 ・EDA連携： ベンダーと協力し、先端プロセス向けDFTツールの評価と手法の改善
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2nm世代の先端ロジック開発におけるデバイス測定業務を担っていただきます。 【具体的には】 ・半導体デバイスのI-V、 C-V、RF S-para、ノイズなどの電気的特性測定および解析業務 ・測定装置やシステムの調整・管理・保守 ・測定データの収集・解析・報告 ・チームメンバーと協力して測定ラボ装置のダウンタイム低減と効率良いラボ運営 下記に挙げる装置の一部または全部を扱える方を歓迎しています。（現在未経験だとしてもこれらに興味があり、将来的にこれらの専門性を身に着けて業務していただけるやる気のある方も大歓迎です。） ■半導体パラメータアナライザー ■パラメトリックテスター ■容量計 ■周波数カウンタ ■フルオートプローバー ■セミオートプローバー ■1／fノイズ測定器 ■熱雑音測定器 ■高周波プローブ ■ネットワークアナライザー
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