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東京都/半導体/年収1200万円以上/30代の求人・転職・中途採用情報
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MASKエンジニア
下記業務をご担当いただきます。 【具体的には】 ・Fill:チップ上でより均一なパターン密度を作成するために使用されるダミー形状の仕様の作成とコーディング、及びFillセル設計を担当いただきます。 ・Retargeting:下流のマスク作成に使用される最終的なウェーハ寸法に合わせて設計形状を変更するコードを作成する責任を負っていただきます。 ・Kerf: CD(Critical Dimension 測定、アライメント、オーバーレイ、その他の計測要件などのプロセス制御ニーズのために工場で使用される KERF (またはフレーム/スクライブ) 内のマクロを作成する責任を負っていただきます。 KERF エンジニアは、配置制約の対象となる領域内にこれらの個別マクロを配置するための自動化のためのコード作成も行っていただきます。 ・Mask Release:マスク作成に関するスケジュールを調整し、後処理されたデータをマスク製造用のマスクメーカーに転送する責任を負っていただきます。 マスクセット全体の購買管理もしていただきます。
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半導体テストチップのレイアウト設計<アナログ>
半導体テストチップのレイアウトDesign及び、プロセスのPPA評価用レイアウトDesignを担当して頂きます。マニュアルでのレイアウトの他に、TCL言語、SKILL言語、その他の言語でスクリプト作成してレイアウト作業をして頂きます。 【具体的には】 先端プロセスのFEOL・BEOLレイアウトルールを理解し、カスタムセル設計可能なレベルのスキルを身に着けて頂く必要があります。また、新たに構築する設計フローに対するトライアル、ツール動作検証、改善提案業務などを担当して頂きます。ジョブローテーションが頻繁にありますので、re-skilling能力が重視されます。
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インフラネットワーク運用業務
同社オフィスや工場(IIM)、データセンター、各拠点を結ぶネットワークおよび、インフラ基盤を構成する各種サーバの運用管理をご担当いただきます。 【具体的には】 ■ネットワーク機器の運用及び管理、障害対応、ユーザサポート。管理機器は、L2/L3 Swich/Router/Firewall/IPS/IDS/その他アプライアンス。 ■インフラサーバ機器の運用及び管理、障害対応、ユーザサポート。管理対象は、VDIサーバ/Proxyサーバ/バックアップサーバ/Syslogサーバ。 ■物理ファシリティの運用及び管理、障害対応、ユーザサポート。管理対象は、ラック/ケーブル/PDU/電源/空調/セキュリティ機器。 ■各協力会社のマネージメント ■新規製品・サービスの選定や導入 ■運用オペレーションフローの立案、ルール策定、各種ドキュメント作成 ■各種トラブルシューティング(不具合調査、協力会社と連携して対応方針の決定)
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TEGレイアウト<デジタル>
半導体テストチップのレイアウトDesign及び、プロセスのPPA評価用レイアウトDesignを担当していただきます。 【具体的には】 EDAツールを使ったディジタル設計全般についてRTLからテープアウトまでを実施していただきます。また、タイミング収束、物理検証、IRdrop/EM検証などのデザイン収束にかかわる業務も担当していただきます。設計業務に関連してTCL言語、SKILL言語、その他の言語にてスクリプト作成をして頂きます。また、新たに構築する設計フローに対するトライアル、ツール動作検証、改善提案業務などを担当して頂きます。ジョブローテーションが頻繁にありますので、re-skilling能力が重視されます。
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PDK(Process Design Kit)開発
2nm世代、及びBeyond 2nmのLSIを設計するためのPDK開発の業務を担っていただきます。以下のいずれかの業務を担っていただきます。 【具体的には】 ・PcellおよびSchematic Symbolの開発、サポート ・物理検証(DRC、 LVS、 ERC、 PERC)ルールの開発、サポート ・寄生素子抽出(LPE)ルールの開発、サポート ・DRM(Design Rule Manual)の開発、サポート ・EMIR(Electro Migration、 IR drop)ルールの開発、サポート ・カスタムレイアウトのオートメーション技術開発、サポート 【使用ツール】 Virtuoso、Spectre、 Voltus-Fi、 Pegasus、Quantus、 Custom Compiler、 HSPICE、ICV、StarRC、Calibre Family等
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海外営業<海外全域向け/半導体製造装置・砥石>
海外全域における、装置/砥石の営業活動全般、及び現地法人のサポート業務をご担当頂きます。ご経験に応じて、欧米または中国、台湾、韓国を除くアジア圏いずれかのエリアをご担当頂きます。入社後1~2年間は国内営業部に籍を置き、半年程度技術研修を受講いただき、製品・業界理解を深めて頂きます。 【具体的には】 ・装置/砥石の新規/深耕開拓営業を行います。 ・本社にて現地法人社員と連携を取りながら業務を行いますが、必要に応じて海外出張し、同行の上直接顧客へアプローチすることもあります。 ・プレゼンテーション資料、仕様書、見積もり作成などによって、現地法人社員のサポートも行います。 ・現地法人を含めた担当企業の月次目標数値管理も行います。 ・本人の希望及び能力に応じて海外駐在もあります。 【魅力】 価格ありきではない、付加価値訴求に特化した営業活動ができます。ディスコの営業担当は売上ノルマがありません。また、営業活動を通じて最先端テクノロジーの発展に寄与することが可能です。 【募集背景】マーケットの需要増に伴う増員 【配属部署】海外営業部 (1~2年の国内営業部研修の可能性あり) 【出張について】 国内外へ適宜発生します 【残業時間】30~40h/月程度
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レイアウトデザインエンジニア <メモリ半導体>
同社のレイアウトデザインエンジニアとして、以下の業務を担当していただきます。 ※経験に応じて以下業務のいずれかをを担当していただきます。 【具体的には】 ■NAND型フラッシュメモリのレイアウト設計業務 -チップレベルおよび大規模~中規模周辺回路でのフロアプラン検討および レイアウト設計・検証 -アナログ回路およびデジタル回路のマニュアルによるレイアウト設計 - 機能回路ブロックおよび配線のフロアプラン設計 ■CADエンジニアとの共同でレイアウト設計環境の構築およびその検証環境の構築 ■共同開発パートナ、自社他拠点とのインターフェイス 【働き方】 ■リモート勤務を合わせたハイブリット勤務可(出社:週3~)
半導体工場建設・施設運転管理業務支援
【業務内容】 半導体工場の建設計画の推進、稼働中の動力・インフラ施設(電気設備、機械設備等含む)工事推進、運転管理改善の支援 【具体的にお任せする業務】 工場の生産技術部門や施工業者と連携しながら、プロジェクトの上流フェーズから稼働後の改善にいたるまで、業務を支援・推進していただきます。 ■新工場建設計画の企画・立案(上流フェーズ):世界最先端の半導体製造装置を導入するための、建屋(建築・構造)および電気・機械設備(空調・衛生・動力供給設備)の仕様検討や建設計画の策定 ■工事推進および施工の支援:安全かつ計画通りの立上げに向けた、施工管理・安全管理に関する技術的な助言や各拠点との調整 ■稼働後のインフラ・動力施設の運転管理改善:既存工場における各種ファシリティ設備の安定化、効率化に向けた活動の支援 ■省エネ・CO2削減施策の推進(脱炭素への貢献):同社独自の技術を駆使した、工場全体のエネルギー効率向上のための企画、省エネ・環境負荷低減施策の立案および改善検討
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DXエンジニア/ディレクター
社内ナレッジ蓄積・共有基盤システムに関する以下の業務についてチームリードまたは担当メンバとして従事いただきます。 【具体的には】 ■企画/予算立案 ■ソリューション検討 ■要件定義~開発 ■運用保守およびエンハンス ※グループ会社との期待値コントロール、同社協力会社とのブリッジカウンターとしての役割を含みます ※経験、得意分野、キャリア意向を伺いながらご担当いただきます ※将来的には他のシステムもご担当いただく予定です 【採用部門が社内で担う機能とミッション】 全社IT/DX戦略に基づき、同社グループの半導体製造装置に関する開発、品質、サービス・サポート、製品ライフサイクルにおけるそれぞれの履歴情報を収集蓄積しナレッジ化をおこなうための情報蓄積・共有基盤の企画・開発デリバリー・運用保守をご担当いただきます。
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フォトニクス/化合物デバイス設計エンジニア
■フォトニクス/化合物デバイス設計エンジニアとして、下記業務をご担当いただきます。 【具体的には】 ・化合物半導体による高速受光器の開発 FDTDやBPMを用いた光導波路素子設計/評価解析、TCAD による高速受光器設計、電磁界シミュレーションによるSパラメータ解析、VNAやAWGを用いた高速デバイスの評価解析 ・設計環境整備、評価環境整備 シミュレータの保守更新、測定器の導入と保守更新 【入社後のキャリア】 これまでの経験を活かして、化合物光半導体のデバイス設計を担当し、スキルに応じて他の設計メンバーのリーディングと育成を担当いただく可能性もあります。経験を重ねる事で、エキスパートとしてプロジェクトマネージメントの役割も担っていただきます。また、当初の経験値に応じてエキスパートからのスタートの可能性もあります。
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デバイス設計・評価<フォトニクスデバイス>
同社では現在、新規ポートフォリオ拡大に向け、最注力分野の1つとして、フォトニクス領域、特に光半導体デバイスの事業拡大を目指しています。R&D部門では、フォトニクス領域での事業ポートフォリオ拡大を目指し、現在複数の研究開発が進められています。2026年へ向けて高速PDとPIC、更に2030年を目標にCPO(Co-packaged Optics)に関わる開発を推進している段階です。この度は、光通信へ向けたフォトニクスデバイスの製品化実現を加速するための人員増強として、本求人を募集します。 ※同社求人票としては「フォトニクス/PICテストエンジニア」の名称となります。 【具体的には】 1.Si-Photoによるコヒーレント方式TxRx PICの設計 Lumericalや電磁界シミュレータ、Tanner等のCADを用いて、Si-Photo PICの構造/レイアウト設計を行う。回路シミュレーションやSパラメータ解析等の手法を用いてPIC全体の動作予測や性能試算を行い、PICの仕様を作成する。 2.PICの評価 VNAやAWGを用いてSi-Photoウェハ/PICの性能評価/動作実証を行う。得られた結果を解析し、PIC設計最適化と仕様策定にフィードバックする。また、試作開発と量産に適したSi-Photoウェハ/PICの評価系を構築し、評価手法を確立する。 【キャリアアップ】 通信用光集積回路の開発に必要な設計/評価技術のエキスパート 、もしくはフォトニクス製品開発を取りまとめるリーダ・マネージャーのキャリアがあります。