メーカー(機械・電気)/年収500万円以上/年間休日120日以上の求人・転職・中途採用情報
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品質管理<炭素繊維強化プラスチック>
■航空宇宙関連機器、電子機器、自動車関連など多岐にわたる用途で利用される同社製品について、品質管理(完成品を三次元測定機で測定)と品質保証業務(ISOの検査)をご担当いただきます。 【具体的には】 ・三次元測定機のプログラムを組み、完成品の座標を測定することで図面通りの寸法になっているかを確認 ・完成した製品に使用した材料、部品等がISO9001やJIS Q 9100等の規格に適合しているかを検査 ・図面等や計測機器の管理 ・顧客対応、不具合対応と検査要領書作成など
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オートモーティブの領域向け技術コンサル業務
同社は先端半導体のメーカーとして先端微細半導体のLSI設計の開発も進めています。同社は領域問わず開発を進めており、今回は自動車領域向けの開発に詳しい経験者をターゲットに自動車領域向け、顧客向けの技術コンサルを募集しています。 【ポジション詳細】 国内海外の自動車領域の顧客向けに「どのようにデバイスが必要か」を規格含めて検討していく中で、技術的な観点で支援を進めます。本ポジションには、ASICの設計エンジニア、プロマネチーム等が連携して関わります。 【同社について】 TSMCが持つ唯一のASIC設計半導体メーカーです。同社は台湾に本社を置き、アメリカ・ヨーロッパ・韓国・中国などグローバルに展開しており、2005年に日本法人として設立されたグループ唯一の「半導体製品・設計開発メーカー」です。TSMC2nm/7nm/6nm/3nmの世界初製品を設計開発したのも同社であり、高い技術力のなかで就業可能です。 【魅力】 ■先端技術に関する習得が可能。まだない領域のチップを推進することから、働きがいとしても抜群です。 ■働きやすい環境・みなとみらい横浜ランドマークタワーが拠点となり、無料の各種ドリンクやスナック等が設置されているリフレッシュコーナーを完備。一般的な社会保険に加え、民間保険会社の医療保険、生命保険に加入。保険料は会社が負担。コアタイムなしのフレックスタイム制であり、柔軟な働き方が可能です。社員と社員の家族を大切にする代表の考えの下、長期勤務が出来るための制度・施策を多数導入しています。
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ASIC/SoC設計エンジニア<Front-End>
■先端プロセス製品開発の需要拡大、更なる高パフォーマンス化に向けての増員採用。大手半導体メーカー出身とともにフロントエンド設計をご対応いただきます。 【具体的には】 適正に応じて以下の業務をご担当いただきます。 - RTL ~ 論理合成&形式検証 - 顧客から受け入れたNetlist/SDC/UPF、CPF、Library等の受け入れチェック - STA (実行&解析&修正、Timing解析&Timing収束戦略立案 等) - STA制約改善提案&修正 等 - 顧客への回路改善提案(低消費電力化、高speed化、小サイズ化 等向け) 【特徴】 ■TSMCが持つ唯一のASIC設計半導体メーカーです。同社は台湾に本社を置き、アメリカ・ヨーロッパ・韓国・中国などグローバルに展開しており、2005年に日本法人として設立されたグループ唯一の「半導体製品・設計開発メーカー」です。TSMC2nm/7nm/6nm/3nmの世界初製品を設計開発したのも同社であり、高い技術力のなかで設計が可能です。 ■働きやすい環境です。 みなとみらい横浜ランドマークタワーが拠点となり、無料の各種ドリンクやスナック等が設置されているリフレッシュコーナーを完備。一般的な社会保険に加え、民間保険会社の医療保険、生命保険に加入。保険料は会社が負担。年間休日129日(2021年度実績)コアタイムなしのフレックスタイム制であり、柔軟な働き方が可能です。社員と社員の家族を大切にする代表の考えの下、長期勤務が出来るための制度・施策を多数導入しています。
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ASIC/SoC設計エンジニア< Back-End>
■先端プロセス製品開発の需要拡大、更なる高パフォーマンス化に向けての増員採用。大手半導体メーカー出身のエンジニアと共にバックエンド設計をご担当いただきます。 【具体的には】 - レイアウト設計(Floorplan~配置~CTS~配線~Timing収束~PV収束) - Pin-Assignment(外部端子、Ball-Pin等)、BUMP設計、RDL - STA結果解析 & Timing収束 - 電源配線構造検討&電源Mesh配線 - Physical Verification(DRC、LVS 等) - IR-drop解析&収束 【特徴】 ■TSMCが持つ唯一のASIC設計半導体メーカーです。同社は台湾に本社を置き、アメリカ・ヨーロッパ・韓国・中国などグローバルに展開しており、2005年に日本法人として設立されたグループ唯一の「半導体製品・設計開発メーカー」です。TSMC2nm/7nm/6nm/3nmの世界初製品を設計開発したのも同社であり、高い技術力のなかで設計が可能です。 ■働きやすい環境です。 みなとみらい横浜ランドマークタワーが拠点となり、無料の各種ドリンクやスナック等が設置されているリフレッシュコーナーを完備。一般的な社会保険に加え、民間保険会社の医療保険、生命保険に加入。保険料は会社が負担。年間休日129日(2021年度実績)コアタイムなしのフレックスタイム制であり、柔軟な働き方が可能です。社員と社員の家族を大切にする代表の考えの下、長期勤務が出来るための制度・施策を多数導入しています。
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Digital設計担当<DFT設計>
Digital設計担当として、下記業務をご担当いただきます。 【具体的には】 ・顧客製品仕様に合わせ最適化した出荷前TESTプランの提案 ・顧客CHIPの回路仕様(回路構成)に合わせ最適化したDFT回路の仕様設計/実装および検証 ・DFT工程の顧客窓口対応(顧客との折衝、進捗報告等) ・DFTツールを活用したTEST回路の実装 (MUXSCAN、MemoryBIST、BoundaryScan、LogicBIST、IP-DFT 等) ・DFTツールでは対応できないTEST回路のRTL設計/検証/論理合成 ・設計実装したDFT回路のTiming制約作成/STAツールでの妥当性チェック/Timing検証結果解析 ・出荷テスト対応部門と協力して出荷テスト用のATE向けTESTボード仕様策定 ・出荷テスト用パタン設計/検証/管理と出荷後テストのデバッグ対応 ・歩留まり向上施策の検討/実施 ・担当製品のDFTリーダーとして社内外各部門との協力/交渉 ・担当製品のDFTリーダーとして自社/協力会社のDFTエンジニアの取り纏め(タスクアサイン/進捗管理/サポート)
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DFT設計リーダー<ASIC/SoC>
DFT設計リーダーとして、下記業務をご担当いただきます。 【具体的には】 ・顧客製品仕様に合わせ最適化した出荷前TESTプランの提案 ・顧客CHIPの回路仕様(回路構成)に合わせ最適化したDFT回路の仕様設計/実装および検証 ・DFT工程の顧客窓口対応(顧客との折衝、進捗報告等) ・DFTツールを活用したTEST回路の実装 (MUXSCAN、MemoryBIST、BoundaryScan、LogicBIST、IP-DFT 等) ・DFTツールでは対応できない特別なTEST回路のRTL設計/検証/論理合成 ・設計実装したDFT回路のTiming制約作成/STAツールでの妥当性チェック/Timing検証結果解析 ・出荷テスト対応部門と協力して出荷テスト用のATE向けTESTボード仕様策定 ・出荷テスト用パタン設計/検証/管理と出荷後テストのデバッグ対応 ・歩留まり向上施策の検討/実施 ・担当製品のDFTリーダーとして社内外各部門との協力/交渉 ・担当製品のDFTリーダーとして自社/協力会社のDFTエンジニアの取り纏め(タスクアサイン/進捗管理/サポート)を行う ・DFT部門マネージャーとして自チームのDFTエンジニアの日常的なマネジメント
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コンサルタント<車載向け半導体>
車載SoC向け顧客に対して 「FuSa(Functional Safety)」をコンサルティング (世界中の顧客が対象)していただきます。 【具体的には】 ・顧客の車載SoC(ASIC)仕様をベースにFuSa対象(ISO26262準拠)となる回路の定義・策定、品質確保手段の立案 ・Safety PlanとHardwere Safety要求をその目標と合わせて定義 ・顧客回路仕様に沿ってFuSa islandを定義 ・対象となるASILグレードの判断・判定 ・FMEDA (Failure Modes Effects and Diagnostics Analysis)をベースとした解析 ・AEC-Q100必要性の判断:AECグレードレベルの判断・判定 ・AEC-Q104必要性の判断:MCM (Multi-Chip-Module) StressテストとDFT手法の立案 ・定義したFuSa対象に対するDFT戦略立案 (LBIST対象箇所・DFTレベル判断 等) ・社内、物理実装設計メンバー (RTL/論理合成/DFT/P&R/PV) との協調対応(定義したFuSa対象が物理実装困難であれば代替案を立案) ・定義したFuSa設定ゴールに沿って顧客の回路設計をサポート(コンサルティング)
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デバイス開発用TEG設計マネージャ
■同社にて、下記業務を担当していただきます。 【具体的には】 ・2nm世代、及びBeyond 2nmの先端ロジック開発におけるTEG設計の全体管理を担当し、チームを率いてTEG設計方針を決め開発を推進 ・部門内エキスパート及び他部門(デバイス、TCAD、プロセスインテグレーション、ビッグデータ解析、PDK、パッケージング、開発企画)との密な連携を図り、開発を確実に遂行しつつ、技術ロードマップの策定、スケジュール管理、予算管理を行い、プロジェクトを円滑に進行 ・DTCOやIIMで生成される数々のインラインデータを基にしたData driven learning iterationとの相乗効果を生みながら、より高度な2nm世代、及びBeyond 2nm世代の技術開発基盤を支える創造的TEG設計を指揮
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AI/IAエンジニア
下記業務をご担当いただきます。 【具体的には】 ・AI (Artificial Intelligence)を活用した2nm世代、及びBeyond 2nm技術開発の加速と短サイクルタイム化とそのために必要なデータセットのIA (Information Architecture)の設計・構築 ・半導体専門エンジニアとの連携を図り、効果的な技術開発を遂行 技術開発の加速と短サイクルタイム化を目的として半導体技術開発と量産技術に対してデプロイを行いますので、基本的な半導体製造プロセスや計測技術、生産方式の知見を習得していただきます。
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FEOLマネージャー
■同社では、まだ⽇本で開発されていない2nmのロジック半導体を開発‧製造を⾏うために、北海道千歳市にIIMと呼ぶ最先端半導体⼯場の建設しています。2027年初頭に量産開始を予定しています。半導体の前⼯程から後⼯程、そして研究開発や量産技術の確⽴を⾏うため、共に⽇本の半導体産業を盛り上げる仲間を募集しています。 【具体的には】 ・2nm世代、及びBeyond 2nmの先端ロジック開発における主にフロントエンドの業務(TEGレイアウト設計含む)を担い、チーム全体のマネジメントを行っていただきます。 ・フロントエンドプロセス技術開発プロジェクトの管理を担当し、チームを率いてプロセス技術開発を推進していただきます。 ・社内他部門(デバイス、PDK、パッケージング、生産技術)や装置・材料メーカーとの密な連携を図り、開発成果を確実に遂行しつつ、技術ロードマップの策定、スケジュール管理、予算管理を行い、プロジェクトを効果的にに進行していただきます。
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エッチングプロセスエンジニア<RIE>
同社の最先端半導体製造プロセスにおいて、Cu Dual Damascene構造の形成に関するエッチング技術開発を担当いただきます。プロセス開発から装置評価、量産立ち上げ支援まで、技術の中核を担うポジションです。 【具体的には】 ・Cu Dual Damascene構造に対応したエッチングプロセスの開発・最適化 ・プラズマエッチング装置の選定・条件設定・評価(ハードマスク、低k材料対応含む) ・微細パターン形成における選択性・異方性・ダメージ制御技術の検討 ・製造工程との連携によるプロセスインテグレーション支援 ・装置メーカーとの技術折衝・共同開発 ・プロセス安定性・再現性の評価および改善提案
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プロセスエンジニア<TSV/RIE>
同社の先端パッケージング技術開発において、TSV(Through-Silicon Via)形成を中心としたRIE(反応性イオンエッチング)プロセスの開発・最適化を担当いただきます。装置評価からプロセス設計、量産立ち上げ支援まで、技術の中核を担うポジションです。 【具体的には】 ・TSV形成における深堀りRIEプロセスの開発・条件最適化 ・シリコン、絶縁膜、バリア層などの選択的エッチング技術の検討 ・プラズマエッチング装置の選定・立ち上げ・評価 ・エッチング後の形状評価(SEM、CD測定、プロファイル解析) ・製造・パッケージング部門との連携によるプロセスインテグレーション支援 ・装置メーカーとの技術折衝・共同開発
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プロセスエンジニア<露光技術担当>
同社の先端半導体製造において、露光機のレシピ・アプリケーションを活用し、リソグラフィプロセスの精度・性能向上を推進する技術開発業務を担当いただきます。装置メーカーとの連携や工程改善を通じて、歩留まり・生産性の向上に貢献していただきます。 【具体的には】 ・露光機(ArF、EUV等)のレシピ開発・最適化(アライメント、フォーカス、ドーズ、マスク補正など) ・リソグラフィ工程の精度・安定性向上に向けたアプリケーション活用 ・CD・Overlay・Focus等のプロセスウィンドウ評価・改善 ・装置メーカーとの技術折衝・共同検討 ・プロセスデータの収集・解析・フィードバック(JMP、Python等) ・製造・プロセス部門との連携による工程改善・歩留まり向上支援
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ポテンシャル採用 D/Lオートメーション
同社では、まだ日本で開発されていない2nmのロジック半導体を開発・製造を行っており、2027年からの量産を予定しています。 今ある技術を次の世代をと継承していくべく、長きにわたって活躍をいただきたいと考えています。 【業務内容】 あなたの専門知識やご経験、キャリア志向に基づき、DLオートメーション部の一員として、製造ITシステムの開発・導入をご担 当いただきます。 ▼製造実行システム(MES)を中心としたソフトウェア開発 MESのカスタマイズ開発: IBM社の半導体向けMESパッケージ「SiView」をベースに、同社の製造プロセスに合わせた機能追加や改修を行います。 Webアプリケーション開発: 製造データや装置状態を可視化し、現場のエンジニアやオペレーターの作業効率を向上させるための、WebベースのUI(ユー ザーインターフェース)を開発します。 システムインテグレーション: MESと、生産計画システム、品質管理システム、装置オンラインシステムといった多数の周辺システムを連携させるためのソフ トウェア開発を行います。
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内部統制<業務プロセス統制>
■マネージャーの指示のもと、同社及び米国子会社の内部統制をご担当頂きます。同社のガバナンス体制を強化する一環として、米国SOX法及び金融商品取引法上の日本版内部統制法の要請を満たす内部統制システムの立上げを推進します。 【具体的には】 ・内部統制計画の策定および評価体制の構築 ・内部統制制度の整備・運用に関する検討、提案、助言、確認 ・業務プロセス統制における対象部門へのヒアリング等を通じて、規則・規程と業務手続を確認し、想定リスクと統制をセットで文書化 ・対象部門から提出された証憑を基に、リスクと統制の整備状況を確認(整備状況) ・整備が確認された統制通りに運用されているかを確認(運用状況) ・統制通りに運用されていない不備に対しては、改善提案を指示及びその妥当性を確認し、改善の進捗をチェック ・内部統制の経営者評価の報告書作成
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DX・AI活用推進<SCM領域におけるデータ分析・自動化>
AIやデータを駆使して、SCM領域の効率化を推進するポジションです。 【具体的には】 ・SCM(特にSD/SCP)領域における業務効率化・高度化に向けたAI/データ活用の企画・推進 ※ SCP:Supply Chain Planning:需給計画・・・「いつ、何を、どこで、どれくらい作って(仕入れて)配置するか」を予測・計画 ※SD:Sales and Distribution:販売物流・・・「注文を受けてから、商品を顧客に届けて、代金を回収するまで」を予測・計画 ・需要予測、需給計画などの業務に対する分析・自動化ロジックの設計・実装および業務への定着推進 ・Python、BIツール、AIサービス等を活用したデータ分析・可視化・業務自動化の推進 ・業務プロセスの課題抽出およびデジタル化・標準化の推進 ・SCM担当と連携したデータドリブンな意思決定プロセスの構築
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DFTエンジニア
■同社にて、下記の(1)または(2)または両方を担当して頂きます。 【具体的には】 (1)歩留やホットスポット解析を目的として、センサIPやDFT(*1)を顧客の設計に組み込み、歩留の低下やホットスポットの原因を故障解析を通じて特定し、前工程プロセスの改善や顧客の設計変更や推奨等の支援を行う (2)複数のダイを実装したチップレットにおいてダイ、インターポーザ、有機基板等における不良個所や電気的特性の劣化の原因を特定するセンサIPやDFT(*1)を顧客の設計に組み込み、故障解析を通じて後工程プロセスの改善や顧客の設計変更や推奨等の支援を行う (*1)DFT: Design for Test
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内部統制<IT統制>
■マネージャーの指示のもと、同社及び米国子会社の内部統制をご担当頂きます。同社のガバナンス体制を強化する一環として、米国SOX法及び金融商品取引法上の日本版内部統制法の要請を満たす内部統制システムの立上げを推進します。 【具体的には】 ・内部統制計画の策定および評価体制の構築 ・内部統制制度の整備・運用に関する検討、提案、助言、確認 ・対象システムやIT運用に関する関係部門へのヒアリングを通じて、IT方針、手順書、運用実態を確認し、主要なITリスクと対応する統制(IT全般統制・業務処理統制)を整理・文書化 ・対象部門から提出された証憑を基に、リスクと統制の整備状況を確認(整備状況) ・整備が確認された統制通りに運用されているかを確認(運用状況) ・統制通りに運用されていない不備に対しては、改善提案を指示及びその妥当性を確認し、改善の進捗をチェック。 ・内部統制の経営者評価の報告書作成
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シャトルマネジメント
■同社にて、下記業務を担当していただきます。 【具体的には】 ・MPW(シャトルロット)の企画・運用・スケジュール管理 ・設計顧客(ファブレス、研究機関等)との技術・進行調整窓口 ・社内プロセス改善、MPWサービスの高度化提案 【MPWとは】 MPW(Multi-Project Wafer)、別名シャトルロットは、半導体製造において「1枚のシリコンウェハを複数のユーザーやプロジェクトでシェアして製造する方式」を意味します。通常、半導体の製造には膨大なコスト(特に回路を転写するための「マスク」代)がかかりますが、これを「相乗り」することで1社あたりの負担を抑える仕組みです。 ※定期的に運行され、複数の乗客(設計データ)を乗せて目的地(物理的なチップ化)へ運ぶ様子が、定期便のバスや宇宙船の「シャトル」に似ていることから上記のように呼ばれています。
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IR・SR
■同社の中長期的な企業価値向上を実現するため、IR・SRの専門家として株主・投資家等の資本市場を中心とする同社ステークホルダーへの情報提供や対話をリードしていただきます。また、将来的な株式上場を展望し、エクイティストーリーの構築や投資家マーケティング、社内体制の整備等についても従事いただきます。 【具体的には】 具体的な業務内容として想定しているものは以下のとおりです。 ・IR・SR戦略全般の企画立案および実行 ・上場に向けたガバナンス体制・ディスクロージャー方針の企画立案 ・国内外の株主・投資家・アナリスト等への情報提供、定期説明会の開催、対話 ・経営陣や社内関係部門への対話内容のフィードバック ・法定・適時・任意開示書類作成およびそれらの作成に向けた体制・業務フローの整備 ・上場申請に向けた書類の作成および各種審査対応 ・株主総会・決算説明会・施設見学会等のIR・SR関連イベントの企画立案および運営 ・資本市場の動向に関するリサーチ ※上記に加え本人のスキル・関心に応じて、エクイティ・ファイナンス等の関連業務にも携わっていただきます。
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