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下記業務をご担当いただきます。 【具体的には】 アドバンスドパッケージ（2.5D／2.xD／3D等）におけるインターポーザやパッケージ基板の設計および開発のためのTEG設計を行っていただきます。また物理設計者の立場から設計フローの構築にも関与いただくポジションです。SiインターポーザではCD（Critical Dimension）測定、アライメント、オーバーレイなどのプロセス制御に必要な計測構造を、KERF（スクライブ）領域内に配置するための構造設計およびレイアウト開発業務もございます。
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■事業部門のパートナーとして、人事戦略の企画・実行を担いながら、新卒採用業務を中心に推進いただきます。 【具体的には】 ・事業戦略に基づく採用計画の策定・実行 ・各部門との採用要件定義、ポジション設計、組織づくりについてのディスカッション ・学校、官公庁などの関係者への訪問、調整、交渉等 ・採用チャネル選定、求人票作成、媒体管理 ・エージェントマネジメント、候補者との折衝 ・面接プロセス設計・運営、クロージング対応 ・採用データ分析、採用プロセス改善 ・HRBPとしての人事課題抽出、組織開発施策の提案・実行 ・採用チームのメンバーマネジメント ・採用から入社、入社式までのプロジェクトマネジメント業務 ・新しい取り組みのPJTオーナー
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■事業部門のパートナーとして、人事戦略の企画・実行を担いながら、中途採用業務を中心に推進いただきます。 【具体的には】 ・事業戦略に基づく採用計画の策定・実行 ・各部門との採用要件定義、ポジション設計、組織づくりについてのディスカッション ・採用チャネル選定、求人票作成、媒体管理 ・エージェントマネジメント、候補者との折衝 ・面接プロセス設計・運営、クロージング対応 ・採用データ分析、採用プロセス改善 ・HRBPとしての人事課題抽出、組織開発施策の提案・実行 ・採用チームのメンバーマネジメント ・採用から入社、入社式までのプロジェクトマネジメント業務 ・新しい取り組みのPJTオーナー
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下記いずれかをご担当いただきます。 【具体的には】 【1】チップレット技術の実現に不可欠な高速インターフェイス（HBM、UCIe、SerDesなど）に関する、アドバンスドパッケージの設計技術を開発していただきます。 【2】チップレット技術の実現に不可欠な高速インターフェイス（HBM、UCIe、SerDesなど）のPHY開発において、パッケージ仕様提案を行って頂きます。 【3】アドバンスドパッケージ（2.5D／2.xD／3D等）に関し、実測と解析のコリレーションを取り電気的な設計ライブラリ整備を行って頂きます。 上記の実務経験がなくても、入社してからOJTを通じて経験を積んで頂きます。
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■以下部署の業務の中から、これまでのご経験・適性やご希望に応じて配属・担当業務が決定となります（選考プロセスの中でご希望をお知らせください）。 【具体的には】 ・日次業務（仕訳・伝票処理、会計システムへの入力業務） ・出納関連業務（預金管理業務、支払処理業務、買掛金未払金管理業務） ・単体決算業務（月次・四半期・年次単体決算業務、計算書類作成、決算報告資料の作成、勘定科目内訳書の作成） ・税務業務（法人税・消費税等の申告業務） ・会計監査対応 ・内部統制の整備 ・NEDO関連業務 【働き方】 フレックスタイム：フルフレックス 在宅勤務：可能ですが原則出社 ※同社では現状各メンバーともほぼ出社しているものの、ご事情に応じて柔軟な対応をしています 残業時間：平均30-40時間／月、今後増員することで減らす予定 出張：千歳に月1回程度、1回あたり1,2泊 【組織構成】部長以下41名、うち正社員12名、派遣社員29名
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■財務（担当～シニアマネージャー）として下記業務を担当していただきます。 【具体的には】 ・財務企画（経営の意思決定に資する情報の収集と企画立案） ・コーポレートファイナンス（エクイティファイナンス／デットファイナンス）の企画立案、実行、社内外関係者との折衝 ・各種ステークホルダー（銀行、証券会社、官公庁、監査法人、株主、投資家等）とのコミュニケーション ・資金管理（キャッシュフローの最適化、財政状況の維持） ・為替管理（為替エクスポージャーの管理と為替リスクヘッジ等） 【求人の魅力】 ・国内最大級の資金調達に携わり、日本を背負う産業に関わるチャンスです。 ・上場を展望した財務管理体制の起ち上げをはじめ、政府・民間企業からのエクイティ調達やメガバンクはじめとした金融機関からのデットによる大型資金調達など、日本国内では稀有な財務経験を積むことができるオポチュニティです。
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■事業拡大と組織成長を支える人事制度・組織運営の企画立案から実行まで幅広く携わっていただきます。 ※経営層と連携し、人事領域全般の方針策定から運用まで、一貫して関与していただく予定です。業務はご経験や習熟度に応じて段階的に担当いただきます。 【具体的には】 ・経営層・部門責任者との連携による人事戦略の策定 ・人事制度（等級・評価・報酬）の企画・設計、制度改定プロジェクトの推進 ・評価・報酬制度の運用・改善の実施 ・事業計画に基づく組織設計・人員計画の立案および各部門との調整 ・従業員サーベイの設計・分析、エンゲージメント向上施策の企画・実行 ・経営者報酬や株式報酬に関わる制度設計、資料作成・情報管理 ・有価証券報告書等の人事関連情報開示に伴うデータ整理・管理および開示資料の作成
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■次世代半導体製造拠点の建設に伴う工事調達業務を担当いただきます。 【具体的には】 ・建設工事（建屋、ユーティリティ、クリーンルーム等）の調達戦略立案と実行 ・建設会社、施工業者との契約交渉・管理 ・工事仕様書・見積書の精査および技術的評価 ・工事スケジュール・コスト・品質の管理支援 ・社内関係部門（施設、製造、環境安全など）との連携による調達プロセスの推進 ・サプライヤー評価およびリスク管理 【勤務地に関して】 勤務地は千歳もしくは麹町で、麹町勤務の場合は千歳への出張が発生します
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■千歳工場（IIM）の建設プロジェクトにおいて、機械設備（ユーティリティ・製造支援設備）の設計・施工・立ち上げ業務を担当いただきます。 【具体的には】 現在IIM-1を建設中ですが、今後更にIIM-2,3,4を建設予定のため、継続的に業務が発生します。 ・半導体工場における機械設備（空調、熱源、コンプレッサー等）の設計・仕様検討 ・EPC業者・施工会社との技術折衝・進捗管理 ・工事計画の立案・施工管理・安全管理支援 ・設備導入に伴う試運転・性能確認・立ち上げ支援 ・社内関係部門（製造、施設、環境安全、品質など）との調整 ・NEDO等の外部機関への技術報告支援（必要に応じて）
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■Rapidus千歳工場の建設プロジェクトにおいて、水処理設備（超純水製造、排水処理、再利用設備等）の設計・施工・立ち上げ業務を担当いただきます。 【具体的には】 環境対応と安定稼働を両立するインフラ構築を、社内外の関係者と連携しながら推進していただきます。 現在IIM-1を建設中ですが、今後更にIIM-2,3,4を建設予定のため、継続的に業務が発生します。 ・半導体工場における水処理設備（超純水、排水、回収・再利用）の設計・仕様検討 ・EPC業者・施工会社との技術折衝・進捗管理 ・工事計画の立案・施工管理・安全管理支援 ・設備導入に伴う試運転・性能確認・立ち上げ支援 ・環境法規・排水基準への対応と社内報告体制の整備 ・社内関係部門（製造、施設、環境安全、品質など）との調整 ・NEDO等の外部機関への技術報告支援（必要に応じて）
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同社は先端半導体のメーカーとして先端微細半導体のLSI設計の開発も進めています。同社は領域問わず開発を進めており、今回は自動車領域向けの開発に詳しい経験者をターゲットに自動車領域向け、顧客向けの技術コンサルを募集しています。 【ポジション詳細】 国内海外の自動車領域の顧客向けに「どのようにデバイスが必要か」を規格含めて検討していく中で、技術的な観点で支援を進めます。本ポジションには、ASICの設計エンジニア、プロマネチーム等が連携して関わります。 【同社について】 TSMCが持つ唯一のASIC設計半導体メーカーです。同社は台湾に本社を置き、アメリカ・ヨーロッパ・韓国・中国などグローバルに展開しており、2005年に日本法人として設立されたグループ唯一の「半導体製品・設計開発メーカー」です。TSMC2nm／7nm／6nm／3nmの世界初製品を設計開発したのも同社であり、高い技術力のなかで就業可能です。 【魅力】 ■先端技術に関する習得が可能。まだない領域のチップを推進することから、働きがいとしても抜群です。 ■働きやすい環境・みなとみらい横浜ランドマークタワーが拠点となり、無料の各種ドリンクやスナック等が設置されているリフレッシュコーナーを完備。一般的な社会保険に加え、民間保険会社の医療保険、生命保険に加入。保険料は会社が負担。コアタイムなしのフレックスタイム制であり、柔軟な働き方が可能です。社員と社員の家族を大切にする代表の考えの下、長期勤務が出来るための制度・施策を多数導入しています。
同社グループは、世界中に最先端プロセスでのファウンダリーを有しており、世界主要トップメーカーからの製造受託製造開発を行っています。その中で、世界各国の主要トップ半導体メーカーからの受注に向け、最先端ツール・プロセスを用いたデザインテクノロジープラットフォーム（DTP）を有しています。 同ポジションでは、同社デザインエンジニアリング部隊（設計スペシャリスト部隊）にて、世界各国のデバイスメーカーと連携を取り、円滑な設計・開発を進めるためのエンジニアリング設計業務を行っていただきます。 【具体的には】以下の通り幅広いポジションで採用を行っています。 APR・物理設計／アナログ回路設計／メモリ設計／レイアウト設計／標準セル設計／特性評価エンジニア／合成エンジニア／DFTエンジニア／設計検証／CADエンジニア等 ＜採用に際して＞ ポテンシャル・即戦力を含む回路設計ポジションを募集しています。 【同社おすすめ理由】 ■最先端プロセス設計が可能： 世界各国のデザインセンターにおいて最新の拠点が同拠点です。3nm,5nmのプロセスノードでのツール含めた半導体設計が可能であり、唯一無二の設計開発が可能です。 ■世界トップの主要デバイスメーカー向け設計が可能： 基本的に海外主要企業向け設計業務を行いますため、常に最新の設計スキルが身につきます。
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■千歳工場における機械設備の運用・改善・保全業務を担当いただきます。 【具体的には】 建設フェーズから量産フェーズへの移行に伴い、安定稼働と効率的な設備管理を実現するための技術支援を行っていただきます。 現在IIM-1を建設中ですが、今後更にIIM-2,3,4を建設予定のため、継続的に業務が発生します。 ・空調、熱源、コンプレッサーなどのユーティリティ設備の運用・改善 ・設備の稼働状況・保全履歴の管理と予防保全の推進 ・設備トラブルの原因分析・対策立案・再発防止活動 ・建設・施工フェーズにおける技術支援（仕様確認、試運転、性能評価など） ・EPC業者・保守業者との技術折衝・契約管理 ・製造部門・環境安全部門との連携による設備改善提案
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■先端プロセス製品開発の需要拡大、更なる高パフォーマンス化に向けての増員採用。大手半導体メーカー出身とともにフロントエンド設計をご対応いただきます。 【具体的には】 適正に応じて以下の業務をご担当いただきます。 - RTL ～ 論理合成＆形式検証 - 顧客から受け入れたNetlist／SDC／UPF、CPF、Library等の受け入れチェック - STA （実行＆解析＆修正、Timing解析＆Timing収束戦略立案 等） - STA制約改善提案＆修正 等 - 顧客への回路改善提案（低消費電力化、高speed化、小サイズ化 等向け） 【特徴】 ■TSMCが持つ唯一のASIC設計半導体メーカーです。同社は台湾に本社を置き、アメリカ・ヨーロッパ・韓国・中国などグローバルに展開しており、2005年に日本法人として設立されたグループ唯一の「半導体製品・設計開発メーカー」です。TSMC2nm／7nm／6nm／3nmの世界初製品を設計開発したのも同社であり、高い技術力のなかで設計が可能です。 ■働きやすい環境です。 みなとみらい横浜ランドマークタワーが拠点となり、無料の各種ドリンクやスナック等が設置されているリフレッシュコーナーを完備。一般的な社会保険に加え、民間保険会社の医療保険、生命保険に加入。保険料は会社が負担。年間休日129日（2021年度実績）コアタイムなしのフレックスタイム制であり、柔軟な働き方が可能です。社員と社員の家族を大切にする代表の考えの下、長期勤務が出来るための制度・施策を多数導入しています。
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■先端プロセス製品開発の需要拡大、更なる高パフォーマンス化に向けての増員採用。大手半導体メーカー出身のエンジニアと共にバックエンド設計をご担当いただきます。 【具体的には】 - レイアウト設計（Floorplan～配置～CTS～配線～Timing収束～PV収束） - Pin-Assignment（外部端子、Ball-Pin等）、BUMP設計、RDL - STA結果解析 ＆ Timing収束 - 電源配線構造検討＆電源Mesh配線 - Physical Verification（DRC、LVS 等） - IR-drop解析＆収束 【特徴】 ■TSMCが持つ唯一のASIC設計半導体メーカーです。同社は台湾に本社を置き、アメリカ・ヨーロッパ・韓国・中国などグローバルに展開しており、2005年に日本法人として設立されたグループ唯一の「半導体製品・設計開発メーカー」です。TSMC2nm／7nm／6nm／3nmの世界初製品を設計開発したのも同社であり、高い技術力のなかで設計が可能です。 ■働きやすい環境です。 みなとみらい横浜ランドマークタワーが拠点となり、無料の各種ドリンクやスナック等が設置されているリフレッシュコーナーを完備。一般的な社会保険に加え、民間保険会社の医療保険、生命保険に加入。保険料は会社が負担。年間休日129日（2021年度実績）コアタイムなしのフレックスタイム制であり、柔軟な働き方が可能です。社員と社員の家族を大切にする代表の考えの下、長期勤務が出来るための制度・施策を多数導入しています。
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■同社千歳工場における水処理設備（純水製造、排水処理、再利用設備等）の運用・改善・保全業務を担当いただきます。 【具体的には】 建設フェーズから量産フェーズへの移行に伴い、安定稼働と効率的な設備管理を実現するための技術支援を行っていただきます。 現在IIM-1を建設中ですが、今後更にIIM-2,3,4を建設予定のため、継続的に業務が発生します。 ・超純水製造設備の運転管理・性能維持・改善活動 ・排水処理設備の運用・水質管理・法令対応（排水基準、環境報告等） ・回収・再利用設備の技術評価・効率改善 ・設備トラブルの原因分析・対策立案・再発防止活動 ・EPC業者・保守業者との技術折衝・契約管理 ・製造・環境安全部門との連携による設備改善提案
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■先端ロジック技術に関するグローバルな共同開発プロジェクトにおいて、同部署内のプロジェクトマネジメント業務全般をご担当いただきます。複数部門・複数企業間にまたがる開発体制の中で、会議体運営、進捗管理、マイルストーン・KPIのトラッキング、成果物の確認などを通じて、プロジェクトの円滑な遂行と成功に貢献いただきます。 【具体的には】 ・プロジェクト計画の策定（WBS・ロードマップ・リスク管理・リソースアロケーション） ・開発マイルストーンおよび成果物（Deliverables）のトラッキングと進捗管理 ・定例会議やレビュー会議の設定／議事録作成／ファシリテーション ・海外パートナーとのコミュニケーション／調整業務 ・プロジェクトKPIの設計／モニタリング／改善提案 ・複数部門／複数プロジェクト間のタスク調整／優先順位整理 ・契約関連情報、技術成果物、知財、ドキュメントの管理 ・技術側／経営層双方とのブリッジ（状況報告・課題提起・意思決定サポート）
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2nm世代以降の最先端半導体プロセス技術の開発を支援する「イネーブルメント・チーム」に所属いただきます。次世代製造プロセスの検証に不可欠な、大規模テストチップのDFT（Design-for-Test：テスト容易化設計）実装をリードしていただきます。 【具体的には】 スキャン挿入、ATPG（自動テストパターン生成）、メモリBIST（自己診断テスト）などの手法を駆使し、歩留まり解析やEDAツールベンダーとの連携を通じて、設計品質とテスト効率の向上を目指していただきます。 ・アーキテクチャ設計：テストチップ向けのDFTアーキテクチャ（スキャン、バウンダリスキャン、メモリBIST）の定義と実装 ・検証：実装したDFT回路の機能・タイミング検証、シミュレーションによるテストカバレッジの評価 ・最適化：テストカバレッジ、コスト、時間のバランスを分析し、最適なテストソリューションを提案 ・連携：RTL設計から物理実装に至るまで、設計チームと協力してDFT機能を統合 ・シリコン評価： ATPG／MBISTパターンの作成・検証、実チップ（シリコン）の立ち上げおよびデバッグ支援 ・解析： シリコンからのテストデータを分析し、系統的な問題を特定して歩留まり（イールド）を改善 ・EDA連携： ベンダーと協力し、先端プロセス向けDFTツールの評価と手法の改善
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■同社では、まだ⽇本で開発されていない2nmのロジック半導体を開発‧製造を⾏うために、北海道千歳市にIIMと呼ぶ最先端半導体⼯場の建設しています。2027年初頭に量産開始を予定しています。半導体の前⼯程から後⼯程、そして研究開発や量産技術の確⽴を⾏うため、共に⽇本の半導体産業を盛り上げる仲間を募集しています。 【具体的には】 ・2nm世代、及びBeyond 2nmの先端ロジック開発における主にフロントエンドの業務（TEGレイアウト設計含む）を担い、チーム全体のマネジメントを行っていただきます。 ・フロントエンドプロセス技術開発プロジェクトの管理を担当し、チームを率いてプロセス技術開発を推進していただきます。 ・社内他部門（デバイス、PDK、パッケージング、生産技術）や装置・材料メーカーとの密な連携を図り、開発成果を確実に遂行しつつ、技術ロードマップの策定、スケジュール管理、予算管理を行い、プロジェクトを効果的にに進行していただきます。
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下記業務をご担当いただきます。 【具体的には】 ・AI （Artificial Intelligence）を活用した2nm世代、及びBeyond 2nm技術開発の加速と短サイクルタイム化とそのために必要なデータセットのIA （Information Architecture）の設計・構築 ・半導体専門エンジニアとの連携を図り、効果的な技術開発を遂行 技術開発の加速と短サイクルタイム化を目的として半導体技術開発と量産技術に対してデプロイを行いますので、基本的な半導体製造プロセスや計測技術、生産方式の知見を習得していただきます。
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■同社にて、下記業務を担当していただきます。 【具体的には】 ・2nm世代、及びBeyond 2nmの先端ロジック開発におけるTEG設計の全体管理を担当し、チームを率いてTEG設計方針を決め開発を推進 ・部門内エキスパート及び他部門（デバイス、TCAD、プロセスインテグレーション、ビッグデータ解析、PDK、パッケージング、開発企画）との密な連携を図り、開発を確実に遂行しつつ、技術ロードマップの策定、スケジュール管理、予算管理を行い、プロジェクトを円滑に進行 ・DTCOやIIMで生成される数々のインラインデータを基にしたData driven learning iterationとの相乗効果を生みながら、より高度な2nm世代、及びBeyond 2nm世代の技術開発基盤を支える創造的TEG設計を指揮
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■同社の中長期的な企業価値向上を実現するため、IR・SRの専門家として株主・投資家等の資本市場を中心とする同社ステークホルダーへの情報提供や対話をリードしていただきます。また、将来的な株式上場を展望し、エクイティストーリーの構築や投資家マーケティング、社内体制の整備等についても従事いただきます。 【具体的には】 具体的な業務内容として想定しているものは以下のとおりです。 ・IR・SR戦略全般の企画立案および実行 ・上場に向けたガバナンス体制・ディスクロージャー方針の企画立案 ・国内外の株主・投資家・アナリスト等への情報提供、定期説明会の開催、対話 ・経営陣や社内関係部門への対話内容のフィードバック ・法定・適時・任意開示書類作成およびそれらの作成に向けた体制・業務フローの整備 ・上場申請に向けた書類の作成および各種審査対応 ・株主総会・決算説明会・施設見学会等のIR・SR関連イベントの企画立案および運営 ・資本市場の動向に関するリサーチ ※上記に加え本人のスキル・関心に応じて、エクイティ・ファイナンス等の関連業務にも携わっていただきます。
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■同社にて、下記業務を担当していただきます。 【具体的には】 ・MPW（シャトルロット）の企画・運用・スケジュール管理 ・設計顧客（ファブレス、研究機関等）との技術・進行調整窓口 ・社内プロセス改善、MPWサービスの高度化提案 【MPWとは】 MPW（Multi-Project Wafer）、別名シャトルロットは、半導体製造において「1枚のシリコンウェハを複数のユーザーやプロジェクトでシェアして製造する方式」を意味します。通常、半導体の製造には膨大なコスト（特に回路を転写するための「マスク」代）がかかりますが、これを「相乗り」することで1社あたりの負担を抑える仕組みです。 ※定期的に運行され、複数の乗客（設計データ）を乗せて目的地（物理的なチップ化）へ運ぶ様子が、定期便のバスや宇宙船の「シャトル」に似ていることから上記のように呼ばれています。
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2nm世代の先端ロジック開発におけるデバイス測定業務を担っていただきます。 【具体的には】 ・半導体デバイスのI-V、 C-V、RF S-para、ノイズなどの電気的特性測定および解析業務 ・測定装置やシステムの調整・管理・保守 ・測定データの収集・解析・報告 ・チームメンバーと協力して測定ラボ装置のダウンタイム低減と効率良いラボ運営 下記に挙げる装置の一部または全部を扱える方を歓迎しています。（現在未経験だとしてもこれらに興味があり、将来的にこれらの専門性を身に着けて業務していただけるやる気のある方も大歓迎です。） ■半導体パラメータアナライザー ■パラメトリックテスター ■容量計 ■周波数カウンタ ■フルオートプローバー ■セミオートプローバー ■1／fノイズ測定器 ■熱雑音測定器 ■高周波プローブ ■ネットワークアナライザー
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Chip Implementation EDA Flow 開発エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■チップ実装EDAフローの有効化（Enablement） ・サインオフ・フローの開発: RC抽出、タイミング解析、タイミング修正のためのサインオフ・フローを開発・最適化し、チップの性能と信頼性を確保する。 ・EDAプラットフォームの開発: 各設計工程の統合、デザインキットの管理、設計データベースの監視を行うEDAプラットフォームを開発・保守し、設計者が効率的に作業できる環境を構築する。 ・汎用CAD／EDA開発: 設計プロセスにおけるボトルネックを解消するため、各種設計課題を解決するEDAツールの開発・改善を行う。 ■設計チームと連携し、フローやツールに対するニーズの特定および要件定義を行う。 ■EDAベンダーと協力し、新機能の導入や既存ツールの最適化を図る。 ■開発したフローやツールの導入支援、ユーザーサポート、トラブルシューティングを行う。 ■最新のEDA技術や業界トレンドを常に把握し、社内フローへの適用可能性を評価する。 ■開発したフローおよびツールに関するドキュメントの作成と維持。
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テストチップ設計エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■テストチップの物理設計およびPPA解析 ・バックエンド（BE）実装および関連フローの開発：チップレベルのプランニング、PG（電源／接地）ネットワーク設計から、フロアプラン、配置（Place）、CTS（クロックツリー合成）、配線（Route）、電力解析（PDNAサインオフ）、および包括的な物理検証まで、バックエンド実装フロー全体を推進する。 ・設計手法およびEDAツール・ユーティリティの開発：バックエンド実装に特化した設計手法と、関連するEDAツールのユーティリティを開発・強化する。これには、新しいプロセス技術から生じる課題へのソリューション作成や、顧客を効果的にサポートするためのユーティリティ開発が含まれる。 ・テクノロジー・ベンチマーク：詳細なテクノロジー・ベンチマークを実施し、新しいプロセス技術のPPA特性を徹底的に理解・評価する。 ■プロセス開発チーム、回路設計チーム、およびEDAベンダーと緊密に連携し、堅牢な設計フローを定義・実装する。 ■タイミング、電力、物理検証のエラーを含む、複雑な物理設計上の問題を分析しデバッグする。 ■設計プロセスおよび手法の継続的な改善に貢献する。 ■設計仕様、手法、および結果を明確かつ簡潔にドキュメント化する。
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デジタルチップ設計エンジニアとして下記業務をご担当いただきます。 【具体的には】 ■標準セルおよびDTCOの推進 ・最先端テクノロジーノード向けの標準セルライブラリの設計、評価、および最適化。 ・DTCO（Design Technology Co-Optimization）活動の計画と実行。回路設計とプロセス技術の連携を強化し、最適なPPA（電力・性能・面積）ターゲットを達成する。 ・カスタムレイアウト、キャラクタライゼーション（特性評価）、および検証フローの開発と改善。 ・設計ルール、プロセスばらつき、および信頼性要件を深く理解した上での設計業務。 ■設計チーム、プロセス・デバイス開発チーム、およびEDAチームと緊密に連携する。 ■PPA目標を達成するため、新しい設計手法やツールの評価および導入を行う。 ■IPベンダーやEDAベンダーとの技術的な協議およびコラボレーション。 ■設計データのドキュメント化および維持管理。
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